参数资料
| 型号： | XRT91L34IV |
| 厂商： | Exar Corporation |
| 文件页数： | 25/38页 |
| 文件大小： | 0K |
| 描述： | IC MULTIRATE CDR QUAD 128LQFP |
| 标准包装： | 72 |
| 类型： | 时钟和数据恢复（CDR），扇出缓冲器（分配），多路复用器 |
| PLL： | 是 |
| 主要目的： | SONET/SDH，STS，STM |
| 输入： | LVDS，LVPECL |
| 输出： | LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 622.08MHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-LQFP |
| 供应商设备封装： | 128-LQFP（14x14） |
| 包装： | 托盘 |
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XRT91L34
31
REV. 1.0.1
QUAD CHANNEL MULTIRATE STS-12/3/1 AND STM-4/1/0 SONET/SDH CDR
NOTE: n denotes channel number.
TABLE 16: MICROPROCESSOR INTERFACE REGISTER 0X09, 0X11, 0X19, 0X21 BIT DESCRIPTION
CONFIGURATION AND INTERRUPT ENABLE CHANNEL REGISTER (CH0 = 0X09, CH1 = 0X11, CH2 = 0X19, CH3 = 0X21)
BIT
NAME
FUNCTION
Register
Type
Default
Value
(HW reset)
D7
Reserved
This Register Bit is Not Used
RO
0
D6
Reserved
This Register Bit is Not Used
RO
0
D5
DATAnRATE1
Data Rate Selection Bit-1 and Bit-0
These bits selects SONET/SDH reception speed rate for each of
the four channels independently according to the logic below.
R/W
0
D4
DATAnRATE0
R/W
0
D3
Reserved
This Register Bit is Not Used
RO
0
D2
Reserved
This Register Bit is Not Used
RO
0
D1
LOLn_IE
Loss of Lock Interrupt Enable
"0" = Masks the LOL interrupt generation
"1" = Enables Interrupt generation
R/W
0
D0
LOSn_IE
Loss of Signal Interrupt Enable
"0" = Masks the LOS interrupt generation
"1" = Enables Interrupt generation
R/W
0
DATANRATE[1:0]
DATA RATE
0
STS-1/STM-0
51.84 Mbps
0
1
STS-3/STM-1
155.52 Mbps
1
0
STS-12/STM-4
622.08 Mbps
1
STS-12/STM-4
622.08 Mbps
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