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参数资料
| 型号： | ZL2106ALCFTK |
| 厂商： | Intersil |
| 文件页数： | 14/29页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 6A 36QFN |
| 标准包装： | 1,000 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.54 V ~ 5.5 V |
| 输入电压： | 4.5 V ~ 14 V |
| PWM 型： | 电压模式 |
| 频率 - 开关： | 200kHz ~ 1MHz |
| 电流 - 输出： | 6A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 36-QFN |
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ZL2106
The soft-start delay period begins when the EN pin is asserted
and ends when the delay time expires. The soft-start delay period
is set using the SS pin. Precise ramp delay timing mode reduces
the delay time variations and is available when the appropriate
bit in the MISC_CONFIG register had been set. Please refer to
Application Note AN2033 for details.
R SS
(k Ω )
10
TABLE 6. DELAY AND RAMP CONFIGURATION
DELAY RAMP
TIME TIME UVLO
(ms) (ms) (V)
5
The soft-start ramp timer enables a precisely controlled ramp to
the nominal V OUT value that begins once the delay period has
expired. The ramp-up is guaranteed monotonic and its slope may
be precisely set using the SS pin. Using the pin-strap method, the
soft-start delay and ramp times can be set to one of three
standard values according to Table 5.
TABLE 5. SOFT-START DELAY AND RAMP SETTINGS
DELAY AND
RAMP TIME
11
12.1
13.3
14.7
16.2
17.8
19.6
10
20
5
10
20
5
10
5
10
2
4.5
SS PIN SETTING
LOW
(ms)
2
UVLO
21.5
23.7
20
5
OPEN
5
7.5V
26.1
10
5
HIGH 10
If the desired soft-start delay and ramp times are not one of the
values listed in Table 5, the times can be set to a custom value by
connecting a resistor from the SS pin to SGND using the
appropriate resistor value from Table 6. The value of this resistor
is measured upon start-up or Restore and will not change if the
resistor is varied after power has been applied to the ZL2106
(see Figure 15).
ZL
R SS
FIGURE 15. SS PIN RESISTOR CONNECTIONS
The soft-start delay and ramp times can also be set to custom
values via the I 2 C/SMBus interface. When the SS delay time is
set to 0ms, the device will begin its ramp-up after the internal
circuitry has initialized (~2ms). When the soft-start ramp period
is set to 0ms, the output will ramp up as quickly as the output
load capacitance and loop settings will allow. It is generally
28.7
31.6
34.8
38.3
42.2
46.4
51.1
56.2
61.9
68.1
75
82.5
90.9
100
110
121
133
147
162
20
5
10
20
5
10
20
5
10
20
5
10
20
5
10
20
5
10
20
10
20
2
5
10
20
5.5
7.5
recommended to set the soft-start ramp to a value greater than
500μs to prevent inadvertent fault conditions due to excessive
inrush current.
14
FN6852.6
February 20, 2013
相关PDF资料 |
PDF描述 |
|---|---|
| ABM10DRTS | CONN EDGECARD 20POS DIP .156 SLD |
| ZL2106ALCFT | IC REG BUCK SYNC ADJ 6A 36QFN |
| ISL8033IRZ-T | IC REG BUCK SYNC ADJ 3A DL 24QFN |
| 16RX30680MT810X16 | CAP ALUM 680UF 16V 20% RADIAL |
| UPM1J100MDD | CAP ALUM 10UF 63V 20% RADIAL |
相关代理商/技术参数 |
参数描述 |
|---|---|
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