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参数资料
| 型号： | ZY7007LG-T3 |
| 厂商： | Power-One |
| 文件页数： | 7/35页 |
| 文件大小： | 0K |
| 描述： | PROGBL CONVERT DC-DC 7A OUT SMD |
| 特色产品： | ZY Series Converters |
| 标准包装： | 1 |
| 系列： | 智能 POL 转换器 |
| 类型： | 非隔离（POL） |
| 输出数： | 1 |
| 电压 - 输入（最小）： | 3V |
| 电压 - 输入（最大）： | 14V |
| Voltage - Output 1： | 0.5 ~ 5.5 V |
| 电流 - 输出（最大）： | 7A |
| 电源（瓦） - 制造商系列： | 38W |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-DIP SMD 模块 |
| 尺寸/尺寸： | 0.87" L x 0.49" W x 0.26" H（22.2mm x 12.5mm x 6.5mm） |
| 包装： | 标准包装 |
| 工作温度： | -40°C ~ 85°C |
| 电源（瓦特）- 最大： | 38.5W |
| 产品目录页面： | 2739 (CN2011-ZH PDF) |
| 其它名称： | 179-2410-6 |
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ZY7007 7A DC-DC Intelligent POL Data Sheet
3V to 14V Input ? 0.5V to 5.5V Output
4.5
Signal Specifications
Parameter
VDD
Conditions/Description
Internal supply voltage
Min
3.15
Nom
3.3
Max
3.45
Units
V
SYNC/DATA Line (SD pin)
ViL_sd
ViH_sd
Vhyst_sd
VoL
Tr_sd
Cnode_sd
Ipu_sd
Freq_sd
Tsynq
T0
LOW level input voltage
HIGH level input voltage
Hysteresis of input Schmitt trigger
LOW level sink current @ 0.5V
Maximum allowed rise time 10/90%VDD
Added node capacitance
Pull-up current source at Vsd=0V
Clock frequency of external SD line
Sync pulse duration
Data=0 pulse duration
-0.5
0.75 x
VDD
0.25 x
VDD
14
0.3
475
22
72
5
0.3 x VDD
VDD + 0.5
0.45 x
VDD
60
300
10
1.0
525
28
78
V
V
V
mA
ns
pF
mA
kHz
% of clock
cycle
% of clock
cycle
Inputs: ADDR0…ADDR4, EN, IM
ViL_x
ViH_x
Vhyst_x
RdnL_ADDR
LOW level input voltage
HIGH level input voltage
Hysteresis of input Schmitt trigger
External pull down resistance
ADDRX forced low
-0.5
0.7 x VDD
0.1 x VDD
0.3 x VDD
VDD+0.5
0.3 x VDD
10
V
V
V
kOhm
Power Good and OK Inputs/Outputs
Iup_PG
Iup_OK
ViL_x
ViH_x
Vhyst_x
IoL
Pull-up current source input forced low PG
Pull-up current source input forced low OK
LOW level input voltage
HIGH level input voltage
Hysteresis of input Schmitt trigger
LOW level sink current at 0.5V
25
175
-0.5
0.7 x VDD
0.1 x VDD
4
110
725
0.3 x VDD
VDD+0.5
0.3 x VDD
20
μ A
μ A
V
V
V
mA
Current Share Bus (CS pin)
Iup_CS
ViL_CS
ViH_CS
Vhyst_CS
IoL
Tr_CS
ZD-00245 Rev. 2.6, 01-Jul-10
Pull-up current source at VCS = 0V
LOW level input voltage
HIGH level input voltage
Hysteresis of input Schmitt trigger
LOW level sink current at 0.5V
Maximum allowed rise time 10/90% VDD
www.power-one.com
0.84
-0.5
0.75 x
VDD
0.25 x
VDD
14
3.1
0.3 x VDD
VDD+0.5
0.45 x
VDD
60
100
Page 7 of 35
mA
V
V
V
mA
ns
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ZY7007LU-Q1 | 制造商:POWER-ONE 制造商全称:Power-One 功能描述:7A DC-DC Intelligent POL 3V to 14V Input - 0.5V to 5.5V Output |
| ZY7007LU-T1 | 制造商:POWER-ONE 制造商全称:Power-One 功能描述:7A DC-DC Intelligent POL 3V to 14V Input - 0.5V to 5.5V Output |
| ZY7007LU-T2 | 制造商:POWER-ONE 制造商全称:Power-One 功能描述:7A DC-DC Intelligent POL 3V to 14V Input - 0.5V to 5.5V Output |
| ZY7007LU-T3 | 制造商:POWER-ONE 制造商全称:Power-One 功能描述:7A DC-DC Intelligent POL 3V to 14V Input - 0.5V to 5.5V Output |
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