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参数资料
| 型号： | 5962D0053605QYX |
| 元件分类： | SRAM |
| 英文描述： | 512K X 8 STANDARD SRAM, 20 ns, CDFP36 |
| 封装： | CERAMIC, DFP-36 |
| 文件页数： | 16/16页 |
| 文件大小： | 138K |
| 代理商： | 5962D0053605QYX |
9
Assumptions:
1. G < VIL (max). If G > VIH (min) then Q(7:0) will be
in three-state for the entire cycle.
2. G high for tAVAV cycle.
W
tAVWL
Figure 5a. SRAM Write Cycle 1: Write Enable - Controlled Access
A(18:0)
Q(7:0)
E
tAVAV2
D(7:0)
APPLIED DATA
tDVWH
tWHDX
tETWH
tWLWH
tWHAX
tWHQX
tWLQZ
tAVWH
tWHWL
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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