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参数资料
| 型号： | AD9548BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/112页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
| 产品变化通告： | AD9548 Mask Change 20/Oct/2010 |
| 标准包装： | 400 |
| 类型： | 时钟/频率发生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 750kHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 88-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 88-LFCSP-VQ（12x12） |
| 包装： | 带卷 (TR) |
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AD9548
Data Sheet
Rev. E | Page 10 of 112
TIME DURATION OF DIGITAL FUNCTIONS
Table 13.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
TIME DURATION OF DIGITAL FUNCTIONS
EEPROM-to-Register Download Time
25
ms
Using default EEPROM storage
sequence (see Register 0x0E10 to
Register 0x0E3F)
Register-to-EEPROM Upload Time
200
ms
Using default EEPROM storage
sequence (see Register 0x0E10 to
Register 0x0E3F
Minimum Power-Down Exit Time
10.5
μs
Dependent on loop-filter bandwidth
Maximum Time from Assertion of the RESET
pin to the M0 to M7 Pins Entering High
Impedance State
45
ns
DIGITAL PLL
Table 14.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
DIGITAL PLL
Phase-Frequency Detector (PFD)
Input Frequency Range
1
107
Hz
Loop Bandwidth
0.001
105
Hz
Programmable design parameter; maximum
Phase Margin
30
89
Degrees
Programmable design parameter
Reference Input (R) Division Factor
1
230
1, 2, …, 1,073,741,824
Integer Feedback (S) Division Factor
8
230
8, 9, …, 1,073,741,824
Fractional Feedback Divide Ratio
0
0.999
Maximum value: 1022/1023.
1
fPFD is the frequency at the input to the phase-frequency detector.
2
fS is the sample rate of the output DAC.
3
fREF is the frequency of the active reference; R is the frequency division factor determined by the R-divider.
DIGITAL PLL LOCK DETECTION
Table 15.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
PHASE LOCK DETECTOR
Threshold Programming Range
0.001
65.5
ns
Threshold Resolution
1
ps
FREQUENCY LOCK DETECTOR
Threshold Programming Range
0.001
16,700
ns
Reference-to-feedback period difference
Threshold Resolution
1
ps
HOLDOVER SPECIFICATIONS
Table 16.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
HOLDOVER SPECIFICATIONS
Frequency Accuracy
<0.01
ppb
Excludes frequency drift of SYSCLK source;
excludes frequency drift of input reference prior
to entering holdover
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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