参数资料
| 型号： | AD9779ABSVZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/56页 |
| 文件大小： | 0K |
| 描述： | DAC 16BIT 1.0GSPS 100-TQFP |
| 产品培训模块： | Data Converter Fundamentals DAC Architectures |
| 设计资源： | Interfacing ADL5370 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0016) Interfacing ADL5371 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0017) Interfacing ADL5372 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0018) Interfacing ADL5373 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0019) Interfacing ADL5374 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0020) Interfacing ADL5375 to AD9779A Dual-Channel, 1 GSPS High Speed DAC (CN0021) |
| 标准包装： | 1,000 |
| 位数： | 16 |
| 数据接口： | 串行 |
| 转换器数目： | 2 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 300mW |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-TQFP 裸露焊盘 |
| 供应商设备封装： | 100-TQFP-EP（14x14） |
| 包装： | 带卷 (TR) |
| 输出数目和类型： | 4 电流，单极 |
| 采样率（每秒）： | 1G |
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AD9776A/AD9778A/AD9779A
Rev. B | Page 10 of 56
PIN CONFIGURATIONS AND FUNCTION DESCRIPTIONS
74
VREF
73
IPTAT
72
AGND
69
CSB
70
RESET
71
IRQ
75
I120
68
SCLK
67
SDIO
66
SDO
64
DGND
63
SYNC_O+
62
SYNC_O–
61
DVDD33
60
DVDD18
59
NC
58
NC
57
NC
56
NC
55
P2D0
54
DGND
53
DVDD18
52
P2D1
51
P2D2
65
PLL_LOCK
PIN 1
100
AV
DD33
99
AG
ND
98
AV
DD33
97
AG
ND
96
AV
DD33
95
AG
ND
94
AG
ND
93
O
U
T
1_P
92
O
U
T
1_N
91
AG
ND
90
AUX
1_P
89
AUX
1_N
88
AG
ND
87
AUX
2_N
86
AUX
2_P
85
AG
ND
84
O
U
T
2_N
83
O
U
T
2_P
82
AG
ND
81
AG
ND
80
AV
DD33
79
AG
ND
78
AV
DD33
77
AG
ND
76
AV
DD33
26
P1
D
4
27
P1
D
3
28
P1
D
2
29
P1
D
1
30
P1
D
0
31
NC
32
DG
ND
33
DV
DD18
34
NC
35
NC
36
NC
37
DA
T
ACL
K
38
DV
DD33
39
T
X
E
NABL
E
/I
Q
S
E
L
E
CT
40
P2
D
11
41
P2
D
10
42
P2
D
9
43
DV
DD18
44
DG
ND
45
P2
D
8
46
P2
D
7
47
P2
D
6
48
P2
D
5
49
P2
D
4
50
P2
D
3
2
CVDD18
3
CGND
4
CGND
7
CGND
6
REFCLK–
5
REFCLK+
1
CVDD18
8
CGND
9
CVDD18
10
CVDD18
12
AGND
13
SYNC_I+
14
SYNC_I–
15
DGND
16
DVDD18
17
P1D11
18
P1D10
19
P1D9
20
P1D8
21
P1D7
22
DGND
23
DVDD18
24
P1D6
25
P1D5
11
CGND
AD9776A
TOP VIEW
(Not to Scale)
ANALOG DOMAIN
DIGITAL DOMAIN
NC = NO CONNECT
06
45
2-
0
02
NOTES
1. FOR OPTIMAL THERMAL PERFORMANCE, THE EXPOSED
PAD SHOULD BE SOLDERED TO THE GROUND PLANE FOR
THE 100-LEAD, THERMALLY ENHANCED TQFP PACKAGE.
Figure 3. AD9776A Pin Configuration
Table 7. AD9776A Pin Function Descriptions
Pin
No.
Mnemonic
Description
Pin
No.
Mnemonic
Description
1
CVDD18
1.8 V Clock Supply.
17
P1D11
Port 1, Data Input D11 (MSB).
2
CVDD18
1.8 V Clock Supply.
18
P1D10
Port 1, Data Input D10.
3
CGND
Clock Ground.
19
P1D9
Port 1, Data Input D9.
4
CGND
Clock Ground.
20
P1D8
Port 1, Data Input D8.
5
REFCLK+
Differential Clock Input.
21
P1D7
Port 1, Data Input D7.
6
REFCLK
Differential Clock Input.
22
DGND
Digital Ground.
7
CGND
Clock Ground.
23
DVDD18
1.8 V Digital Supply.
8
CGND
Clock Ground.
24
P1D6
Port 1, Data Input D6.
9
CVDD18
1.8 V Clock Supply.
25
P1D5
Port 1, Data Input D5.
10
CVDD18
1.8 V Clock Supply.
26
P1D4
Port 1, Data Input D4.
11
CGND
Clock Ground.
27
P1D3
Port 1, Data Input D3.
12
AGND
Analog Ground.
28
P1D2
Port 1, Data Input D2.
13
SYNC_I+
Differential Synchronization Input.
29
P1D1
Port 1, Data Input D1.
14
SYNC_I
Differential Synchronization Input.
30
P1D0
Port 1, Data Input D0 (LSB).
15
DGND
Digital Ground.
31
NC
No Connect.
16
DVDD18
1.8 V Digital Supply.
32
DGND
Digital Ground.
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PDF描述 |
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参数描述 |
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