参数资料
| 型号： | AD9948KCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 5/28页 |
| 文件大小： | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 40-LFCSP |
| 标准包装： | 1 |
| 类型： | CCD 信号处理器，10 位 |
| 输入类型： | 逻辑 |
| 输出类型： | 逻辑 |
| 接口： | 3 线串口 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 40-LFCSP |
| 包装： | 托盘 |
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REV. 0
AD9948
–13–
Table VIII. AFE Operation Register Detail
Data Bit
Default
Address
Content
Value
Name
Description
00
[1:0]
0
PWRDOWN
0 = Normal Operation.
1 = Reference Standby.
2/3 = Total Power-Down.
[2]
1
CLPENABLE
0 = Disable OB Clamp.
1 = Enable OB Clamp.
[3]
0
CLPSPEED
0 = Select Normal OB Clamp Settling.
1 = Select Fast OB Clamp Settling.
[4]
0
FASTUPDATE
0 = Ignore VGA Update.
1 = Very Fast Clamping when VGA Is Updated.
[5]
0
PBLK_LVL
DOUT Value during PBLK.
0 = Blank to Zero.
1 = Blank to Clamp Level.
[7:6]
0
TEST MODE
Test Operation Only. Set to zero.
[8]
0
DCBYP
0 = Enable DC Restore Circuit.
1 = Bypass DC Restore Circuit during PBLK.
[9]
0
TESTMODE
Test Operation Only. Set to zero.
[11:10]
0
CDSGAIN
Adjustment of CDS Gain.
0 = 0 dB.
01= –2 dB.
10 = –4 dB.
11 = 0 dB.
Table IX. AFE Control Register Detail
Data Bit
Default
Address
Content
Value
Name
Description
04
[1:0]
0
COLORSTEER
0 = Off.
1 = Progressive.
2 = Interlaced.
3 = Three Field.
[2]
1
PXGAENABLE
0 = Disable PxGA.
1 = Enable PxGA.
[3]
0
DOUTDISABLE
0 = Data Outputs Are Driven.
1 = Data Outputs Are Three-Stated.
[4]
0
DOUTLATCH
0 = Latch Data Outputs with DOUT Phase.
1 = Output Latch Transparent.
[5]
0
GRAYENCODE
0 = Binary Encode Data Outputs.
1= Gray Encode Data Outputs.
相关PDF资料 |
PDF描述 |
|---|---|
| AD9949KCPZ | IC CCD SIGNAL PROCESSOR 40-LFCSP |
| AD9951YSVZ | IC DDS DAC 14BIT 1.8V 48-TQFP |
| AD9952YSVZ-REEL7 | IC DDS DAC 14BIT 1.8V 48TQFP |
| AD9953YSVZ-REEL7 | IC DDS DAC 14BIT 1.8V 48TQFP |
| AD9954YSVZ-REEL7 | IC DDS DAC 14BIT 1.8V 48TQFP |
相关代理商/技术参数 |
参数描述 |
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| AD9949 | 制造商:AD 制造商全称:Analog Devices 功能描述:12-Bit CCD Signal Processor with Precision Timing Core |
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| AD9949BCBZRL | 制造商:Analog Devices 功能描述: |
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