参数资料
型号: ADCLK846/PCBZ
厂商: Analog Devices Inc
文件页数: 16/16页
文件大小: 0K
描述: BOARD EVALUATION FOR ADCLK846
设计资源: Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
标准包装: 1
主要目的: 计时,时钟缓冲器 / 驱动器 / 接收器 / 变换器
已用 IC / 零件: ADCLK846
主要属性: 6 LVDS/12 CMOS 输出
次要属性: CMOS,LVDS 输出
已供物品:
ADCLK846
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900
400
500
600
700
800
10
0
20
0
30
0
40
0
50
0
60
0
70
0
80
0
90
0
1000
1100
1200
1300
1400
1500
1600
1700
D
IFF
E
R
E
N
TI
A
L
O
U
TP
U
T
S
W
IN
G
(
m
V
p-
p
)
INPUT FREQUENCY (MHz)
07
22
6-
009
Figure 9. LVDS Differential Output Swing vs. Input Frequency
150
125
100
75
50
25
0
200
400
600
800
1000
1200
1400
1600
1800
CUR
RE
NT
(
m
A)
FREQUENCY (MHz)
07
22
6-
110
Figure 10. LVDS Current vs. Frequency, All Banks Set to LVDS
500
450
400
350
300
250
200
150
100
50
0
02
2.0
1.5
1.0
0.5
JI
T
E
R
(
f S
rm
s)
INPUT SLEW RATE (V/ns)
.5
07
22
6-
011
Figure 11. Additive Broadband Jitter vs. Input Slew Rate
–80
–90
–100
–110
–120
–130
–140
–150
–160
–170
–180
10
100M
10M
1M
100k
10k
1k
100
P
HAS
E
N
O
IS
E
(d
Bc/
H
z)
FREQUENCY OFFSET (Hz)
ABSOLUTE PHASE NOISE MEASURED @ 1GHz WITH AGILENT
E5052 USING WENZEL CLOCK SOURCE CONSISTING OF A
WENZEL 100MHz CRYSTAL OSCILLATOR (P/N 500-06672),
WENZEL 5× MULTIPLIER (P/N LNOM-100-5-13-14-F-A), AND A
WENZEL 2× MULTIPLIER (P/N LNDD-500-14-14-1-D).
07
22
6-
112
CLOCK SOURCE
ADCLK846
Figure 12. Absolute Phase Noise LVDS at 1000 MHz
200
0
50
100
150
25
50
75
100
125
150
175
225
200
250
CUR
RE
NT
(
m
A)
FREQUENCY (MHz)
07
22
6-
113
BOTH BANKS CMOS
BANK A CMOS,
BANK B LVDS
BANK A LVDS,
BANK B CMOS
BOTH BANKS LVDS
Figure 13. LVDS/CMOS Current vs. Frequency with Various Logic
Combinations
55
45
46
47
48
49
50
51
52
53
54
0
50
100
150
200
250
DUT
Y
CY
CL
E
(%
)
FREQUENCY (MHz)
07
22
6-
114
Figure 14. CMOS Output Duty Cycle vs. Frequency, 10 pF Load
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PDF描述
GBA24DTMT CONN EDGECARD 48POS R/A .125 SLD
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H8PPS-4036G DIP CABLE - HDP40S/AE40G/HDP40S
GEA35DTMN CONN EDGECARD 70POS R/A .125 SLD
VE-J01-EZ-S CONVERTER MOD DC/DC 12V 25W
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参数描述
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