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参数资料
| 型号： | ADM1069ACP |
| 厂商： | Analog Devices, Inc. |
| 英文描述： | SUPER SEQUENCER-TM WITH MARGINING CONTROL AND AUXILIARY ADC INPUTS |
| 中文描述： | 超时序与裕度控制以及辅助ADC输入商标 |
| 文件页数： | 30/32页 |
| 文件大小： | 626K |
| 代理商： | ADM1069ACP |
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ADM1069
Preliminary Technical Data
Rev. PrB | Page 30 of 32
0
ASLAVE
S
W A
2
(BLOCK READ)
4
1
3
A
5
S
6
ASLAVE
7
BYTE
9
10
12
11
A
R A
8
D1
D32
13
A
14
P
A
Figure 45. Block Read from EEPROM or RAM
Error Correction
The ADM1069 provides the option of issuing a PEC (packet
error correction) byte after a write to RAM, a write to EEPROM,
a block write to RAM/EEPROM, or a block read from RAM/
EEPROM. This enables the user to verify that the data received
by or sent from the ADM1069 is correct. The PEC byte is an
optional byte sent after that last data byte has been written to or
read from the ADM1069. The protocol is as follows:
1.
The ADM1069 issues a PEC byte to the master. The master
checks the PEC byte and issues another block read, if the
PEC byte is incorrect.
2.
A no acknowledge (NACK) is generated after the PEC byte
to signal the end of the read.
Note that the PEC byte is calculated using CRC-8. The frame
check sequence (FCS) conforms to CRC-8 by the polynomial
C
(
x
) =
x
8
+
x
2
+
x
1
+ 1
See the SMBus 1.1 specification for details.
An example of a block read with the optional PEC byte is
shown in Figure 46.
0
SLAVE
ADDRESS
S
W A
2
COMMAND 0xFD
(BLOCK READ)
4
1
3
A
5
S
6
SLAVE
ADDRESS
7
BYTE
COUNT
9
10
12
11
A
R A
8
DATA
1
D32
A
13
PEC
14
A
15
P
A
Figure 46. Block Read from EEPROM or RAM with PEC
相关PDF资料 |
PDF描述 |
|---|---|
| ADM1069ACP-REEL | SUPER SEQUENCER-TM WITH MARGINING CONTROL AND AUXILIARY ADC INPUTS |
| ADM1069ACP-REEL7 | SUPER SEQUENCER-TM WITH MARGINING CONTROL AND AUXILIARY ADC INPUTS |
| ADM1070 | -48 V Hot Swap Controller |
| ADM1070ART | -48 V Hot Swap Controller |
| ADM1072ARQ | Dual, USB 2.0 Full/Standby Power Controller with Supply Steering |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ADM1069ACP-REEL | 制造商:AD 制造商全称:Analog Devices 功能描述:SUPER SEQUENCER-TM WITH MARGINING CONTROL AND AUXILIARY ADC INPUTS |
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