参数资料
| 型号： | ADN4605ABPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 17/56页 |
| 文件大小： | 0K |
| 描述： | IC CROSSPOINT SWITCH 352BGA |
| 标准包装： | 1 |
| 系列： | XStream™ |
| 功能： | 交叉点开关 |
| 电路： | 1 x 40:40 |
| 电压电源： | 单电源 |
| 电压 - 电源，单路/双路(±)： | 2.25 V ~ 3.6 V |
| 电流 - 电源： | 55mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 352-LBGA 裸露焊盘 |
| 供应商设备封装： | 352-BGA-EP（35x35） |
| 包装： | 托盘 |
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ADN4605
Data Sheet
Rev. A | Page 24 of 56
THEORY OF OPERATION
INTRODUCTION
The ADN4605 is a 40 × 40, buffered, asynchronous crosspoint
switch that provides input equalization, output preemphasis,
and output level programming capabilities. The receivers
integrate an equalizer that is optimized to compensate for
typical backplane losses. The switch supports multicast and
broadcast operation, allowing the ADN4605 to work in
redundancy and port replication applications.
The ADN4605 is configured through either the serial or parallel
control interface. The serial or parallel control interface is
selected using the SER/PAR dedicated control pin. The serial
interface supports both I2C and SPI protocols selected using the
function differently depending on which programming
interface is selected, as described in Table 8.
EQ
Rx
Tx
PRE-
EMPHASIS
40 × 40
SWITCH
MATRIX
CONNECTION
MAP 1
CONNECTION
MAP 0
PARALLEL/SERIA L CONTROL
LOGIC INTERFACE
PRE-
EMPHASIS
LEVEL
SETTINGS
OUTPUT
LEVEL
SETTINGS
ADN4605
VCC
VEE
DVCC
OP[39:0]
VTTOA,
VTTOB
ON[39:0]
IP[39:0]
VTTIA,
VTTIB
IN[39:0]
I2C/SPI
(UPDATE)
SDI/RE
SCL/SCK/
WE
RESET
SER/PAR
CS
EQUALIZATION
SETTINGS
DATA[1]
(UPDATE)
DATA[0]/
SDA/SDO
DATA[7:2]
ADDR[7:0]
09796-
007
Figure 40. Block Diagram
Table 8. Parallel/Serial Interface Pin Control
Pin No.
Pin Name
Parallel Mode
(SER/PAR = 0)
I2C Mode
(SER/PAR = 1, I2C/SPI = 1)
SPI Mode
(SER/PAR = 1, I2C/SPI = 0)
Pin Function
K4
SER/PAR
Serial/parallel control interface
selection
Serial/parallel control interface
selection
Serial/parallel control interface
selection
J4
I2C/SPI/UPDATE
Update strobe
I2C/SPI control interface selection
H23
WE/SCL/SCK
Parallel write strobe
I2C clock
SPI clock
J23
RE/SDI
Parallel read strobe
N/A
SPI data input
K23
CS
Chip select
N/A
Chip select
L23
DATA0/SDA/SDO
Parallel register data bit (LSB)
I2C data input
SPI data output
M23
DATA1/UPDATE
Parallel register data bits
Update strobe
N23, P23,
R23, T23,
U23, V23
DATA2 to DATA7
Parallel register data bits
N/A
L4
RESET
Device register reset (active
low)
Device register reset (active low)
M4
ADDR0
Parallel register address bit
(LSB)
N/A
N4, P4, R4,
T4, U4, V4,
W4
ADDR1to
ADDR7
Parallel register address bits
I2C LSB device address to I2C MSB
device address
N/A
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