参数资料
型号: ADP5585ACBZ-00-R7
厂商: Analog Devices Inc
文件页数: 34/40页
文件大小: 0K
描述: IC PORT EXPANDER 10I/O 16WLSCP
标准包装: 1
应用: 小键盘输入,输入/输出扩展
接口: I²C
封装/外壳: 16-UFBGA,WLCSP
供应商设备封装: 16-WLCSP(1.59x1.59)
包装: 标准包装
安装类型: 表面贴装
其它名称: ADP5585ACBZ-00-R7DKR
ADP5585
Data Sheet
Rev. C | Page 4 of 40
Parameter
Symbol
Test Conditions/Comments
Min
Typ
Max
Unit
I2C TIMING SPECIFICATIONS
Delay from UVLO/Reset Inactive to I2C Access
60
μs
SCL Clock Frequency
fSCL
0
1000
kHz
SCL High Time
tHIGH
0.26
μs
SCL Low Time
tLOW
0.5
μs
Data Setup Time
tSU; DAT
50
ns
Data Hold Time
tHD; DAT
0
μs
Setup Time for Repeated Start
tSU; STA
0.26
μs
Hold Time for Start/Repeated Start
tHD; STA
0.26
μs
Bus Free Time for Stop and Start Condition
tBUF
0.5
μs
Setup Time for Stop Condition
tSU; STO
0.26
μs
Data Valid Time
tVD; DAT
0.45
μs
Data Valid Acknowledge
tVD; ACK
0.45
μs
Rise Time for SCL and SDA
tR
120
ns
Fall Time for SCL and SDA
tF
120
ns
Pulse Width of Suppressed Spike
tSP
0
50
ns
Capacitive Load for Each Bus Line
550
pF
1 All limits at temperature extremes are guaranteed via correlation using standard statistical quality control (SQC). Typical values are at TA = 25°C, VDD = 1.8 V.
2 Guaranteed by design.
3 All timers are referenced from the base oscillator and have the same ±10% accuracy.
4 CB is the total capacitance of one bus line in picofarads.
TIMING DIAGRAM
SDA
SCL
SDA
SCL
S
Sr
PS
FIRST CLOCK CYCLE
NINTH CLOCK
1/
fSCL
70%
30%
70%
30%
70%
30%
70%
30%
70%
30%
70%
30%
70%
30%
tF
tR
tHIGH
tVD; DAT
tSU; DAT
tSU; STA
tHD; DAT
tHD; STA
tVD; ACK
tSP
tSU; STO
tBUF
tLOW
tHD; STA
VIL = 0.3VDD
VIH = 0.7VDD
09
84
1-
0
02
Figure 2. I2C Interface Timing Diagram
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PDF描述
0533980471 CONN HEADER 4POS 1.25MM VERT SMD
1604398-2 CONN 1-POLE MODULAR 1/0 AWG BLCK
1604398-4 CONN 1-POLE MODULAR 1/0 AWG RED
TXS02326RGER IC SIM CARD MUX 2:1 24VQFN
MS3114E12-8PW CONN RCPT 8POS JAM NUT W/PINS
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参数描述
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