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参数资料
| 型号： | ADSP-21371KSWZ-2B |
| 厂商： | Analog Devices Inc |
| 文件页数： | 13/48页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 266MHZ 208-LQFP |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI |
| 时钟速率： | 266MHz |
| 非易失内存： | ROM（512 kB） |
| 芯片上RAM： | 128kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-LQFP 裸露焊盘 |
| 供应商设备封装： | 208-LQFP-EP（28x28） |
| 包装： | 托盘 |
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ADSP-21371
Clock Input
Table 14. Clock Input
266 MHz
Unit
Parameter
Min
Max
Timing Requirements
tCK
CLKIN Period
22.51
3202
ns
tCKL
CLKIN Width Low
101
1802
ns
tCKH
CLKIN Width High
101
1802
ns
tCKRF
CLKIN Rise/Fall (0.4 V to 2.0 V)
6
ns
tCCLK
3
CCLK Period
3.751
10
ns
1 Applies only for CLKCFG1–0 = 00 and default values for PLL control bits in PMCTL.
2 Applies only for CLKCFG1–0 = 01 and default values for PLL control bits in PMCTL.
3 Any changes to PLL control bits in the PMCTL register must meet core clock timing specification tCCLK.
CLKIN
t
CK
t
CKH
t
CKL
Figure 5. Clock Input
Clock Signals
The ADSP-21371 can use an external clock or a crystal. See the
CLKIN pin description in Table 5. The programmer can config
ure the ADSP-21371 to use its internal clock generator by
connecting the necessary components to CLKIN and XTAL.
Figure 6 shows the component connections used for a crystal
operating in fundamental mode. Note that the clock rate is
achieved using a 16.67 MHz crystal and a PLL multiplier ratio
16:1 (CCLK:CLKIN achieves a clock speed of 266 MHz). To
achieve the full core clock rate, programs need to configure the
multiplier bits in the PMCTL register.
C1
22pF
Y1
R1
1M
*
XTAL
CLKIN
C2
22pF
16.67 MHz
R2
47
*
ADSP-2137X
R2 SHOULD BE CHOSEN TO LIMIT CRYSTAL
DRIVE POWER. REFER TO CRYSTAL
MANUFACTURER’S SPECIFICATIONS
*TYPICAL VALUES
Figure 6. 266 MHz Operation (Fundamental Mode Crystal)
Rev. 0
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June 2007
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参数描述 |
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