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参数资料
| 型号： | ADSP-21469BBCZ-3 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 18/72页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32/40BIT 400MHZ 324BGA |
| 产品变化通告： | Pin Function Change 08/Mar/2012 |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI，EBI/EMI，I²C，SCI，SPI，SSP，UART/USART |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 5Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.05V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 324-BGA，CSPBGA |
| 供应商设备封装： | 324-CSPBGA |
| 包装： | 托盘 |
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ADSP-21469
Rev. 0
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June 2010
Reset
Running Reset
The following timing specification applies to
RESETOUT/RUNRSTIN pin when it is configured as
RUNRSTIN.
Table 19. Reset
Parameter
Min
Max
Unit
Timing Requirements
tWRST
1
RESET Pulse Width Low
4 × tCK
ns
tSRST
RESET Setup Before CLKIN Low
8
ns
1 Applies after the power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 100 ms while RESET is low, assuming stable
VDD and CLKIN (not including start-up time of external clock oscillator).
Figure 9. Reset
CLKIN
RESET
tSRST
tWRST
Table 20. Running Reset
Parameter
Min
Max
Unit
Timing Requirements
tWRUNRST
Running RESET Pulse Width Low
4 × tCK
ns
tSRUNRST
Running RESET Setup Before CLKIN High
8
ns
Figure 10. Running Reset
CLKIN
RUNRSTIN
tWRUNRST
tSRUNRST
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PDF描述 |
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