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参数资料
| 型号： | ADSP-21469BBCZ-3 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 53/72页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32/40BIT 400MHZ 324BGA |
| 产品变化通告： | Pin Function Change 08/Mar/2012 |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI，EBI/EMI，I²C，SCI，SPI，SSP，UART/USART |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 5Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.05V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 324-BGA，CSPBGA |
| 供应商设备封装： | 324-CSPBGA |
| 包装： | 托盘 |
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ADSP-21469
Rev. 0
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June 2010
Universal Asynchronous Receiver-Transmitter
(UART) Ports—Receive and Transmit Timing
For information on the UART port receive and transmit opera-
tions, see the ADSP-214xx SHARC Hardware Reference Manual.
2-Wire Interface (TWI)—Receive and Transmit Timing
For information on the TWI receive and transmit operations,
see the ADSP-214xx SHARC Hardware Reference Manual.
JTAG Test Access Port and Emulation
Table 54. JTAG Test Access Port and Emulation
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
5
ns
tHTAP
TDI, TMS Hold After TCK High
6
ns
tSSYS
1
1 System Inputs = AMI_DATA, DDR2_DATA, CLKCFG1-0, BOOTCFG2-0 RESET, DAI, DPI, FLAG3-0.
System Inputs Setup Before TCK High
7
ns
tHSYS
1
System Inputs Hold After TCK High
18
ns
tTRSTW
TRST Pulse Width
4 × tCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
10
ns
tDSYS
2
2 System Outputs = AMI_ADDR/DATA, DDR2_ADDR/DATA, AMI_CTRL, DDR2_CTRL, DAI, DPI, FLAG3-0, EMU.
System Outputs Delay After TCK Low
tCK ÷ 2 + 7
ns
Figure 43. IEEE 1149.1 JTAG Test Access Port
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tTCK
tSTAP
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
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PDF描述 |
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