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参数资料
| 型号： | ADSP-21488BSWZ-4A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 19/68页 |
| 文件大小： | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 100LQFP |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 3Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.10V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP 裸露焊盘 |
| 供应商设备封装： | 100-LQFP-EP（14x14） |
| 包装： | 托盘 |
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Rev. B
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March 2013
Reset
Running Reset
The following timing specification applies to
RESETOUT/RUNRSTIN pin when it is configured as
RUNRSTIN.
Table 21. Reset
Parameter
Min
Max
Unit
Timing Requirements
tWRST
1
RESET Pulse Width Low
4 × tCK
ns
tSRST
RESET Setup Before CLKIN Low
8
ns
1 Applies after the power-up sequence is complete. At power-up, the processor’s internal phase-locked loop requires no more than 100 μ while RESET is low, assuming stable
VDD and CLKIN (not including start-up time of external clock oscillator).
Figure 8. Reset
CLKIN
RESET
tSRST
tWRST
Table 22. Running Reset
Parameter
Min
Max
Unit
Timing Requirements
tWRUNRST
Running RESET Pulse Width Low
4 × tCK
ns
tSRUNRST
Running RESET Setup Before CLKIN High
8
ns
Figure 9. Running Reset
CLKIN
RUNRSTIN
tWRUNRST
tSRUNRST
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参数描述 |
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