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参数资料
| 型号： | ADSP-21488BSWZ-4A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 21/68页 |
| 文件大小： | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 100LQFP |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 3Mb |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.10V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP 裸露焊盘 |
| 供应商设备封装： | 100-LQFP-EP（14x14） |
| 包装： | 托盘 |
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Rev. B
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March 2013
Timer PWM_OUT Cycle Timing
The following timing specification applies to timer0 and timer1
in PWM_OUT (pulse-width modulation) mode. Timer signals
are routed to the DPI_P14–1 pins through the DPI SRU. There-
fore, the timing specifications provided below are valid at the
DPI_P14–1 pins.
Timer WDTH_CAP Timing
The following timing specification applies to timer0 and timer1,
and in WDTH_CAP (pulse-width count and capture) mode.
Timer signals are routed to the DPI_P14–1 pins through the
SRU. Therefore, the timing specification provided below is valid
at the DPI_P14–1 pins.
Table 25. Timer PWM_OUT Timing
Parameter
Min
Max
Unit
Switching Characteristic
tPWMO
Timer Pulse Width Output
2 × tPCLK – 1.2
2 × (231 – 1) × tPCLK
ns
Figure 12. Timer PWM_OUT Timing
PWM
OUTPUTS
tPWMO
Table 26. Timer Width Capture Timing
Parameter
Min
Max
Unit
Timing Requirement
tPWI
Timer Pulse Width
2 × tPCLK
2 × (231 – 1) × tPCLK
ns
Figure 13. Timer Width Capture Timing
TIMER
CAPTURE
INPUTS
tPWI
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PDF描述 |
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参数描述 |
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