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参数资料
型号： ADSP-21488BSWZ-4A
厂商： Analog Devices Inc
文件页数： 29/68页
文件大小： 0K
描述： IC CCD SIGNAL PROCESSOR 100LQFP
标准包装： 1
系列： SHARC®
类型： 浮点
接口： EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART
时钟速率： 400MHz
非易失内存： 外部
芯片上RAM： 3Mb
电压 - 输入/输出： 3.30V
电压 - 核心： 1.10V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 100-LQFP 裸露焊盘
供应商设备封装： 100-LQFP-EP（14x14）
包装： 托盘
ADSP-21483/ADSP-21486/ADSP-21487/ADSP-21488/ADSP-21489
Rev. B
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March 2013
AMI Write
Use these specifications for asynchronous interfacing to memo-
ries. Note that timing for AMI_ACK, ADDR, DATA, AMI_RD,
AMI_WR, and strobe timing parameters only apply to asyn-
chronous access mode.
Table 33. AMI Write
Parameter
Min
Max
Unit
Timing Requirements
tDAAK
1, 2
AMI_ACK Delay from Address, Selects
tSDCLK – 9.7 + W
ns
tDSAK
1, 3
AMI_ACK Delay from AMI_WR Low
W – 6
ns
Switching Characteristics
tDAWH
2
Address Selects to AMI_WR Deasserted
tSDCLK –3.1+ W
ns
tDAWL
2
Address Selects to AMI_WR Low
tSDCLK –3
ns
tWW
AMI_WR Pulse Width
W – 1.3
ns
tDDWH
Data Setup Before AMI_WR High
tSDCLK –3.7+ W
ns
tDWHA
Address Hold After AMI_WR Deasserted
H + 0.15
ns
tDWHD
Data Hold After AMI_WR Deasserted
H
ns
tDATRWH
4
Data Disable After AMI_WR Deasserted
tSDCLK – 4.3 + H
tSDCLK + 4.9 + H
ns
tWWR
5
AMI_WR High to AMI_WR Low
tSDCLK –1.5+ H
ns
tDDWR
Data Disable Before AMI_RD Low
2 × tSDCLK – 6
ns
tWDE
AMI_WR Low to Data Enabled
tSDCLK – 3.7
ns
W = (number of wait states specified in AMICTLx register) × tSDCLK
H = (number of hold cycles specified in AMICTLx register) × tSDCLK
1 AMI_ACK delay/setup: System must meet tDAAK, or tDSAK, for deassertion of AMI_ACK (low).
2 The falling edge of MSx is referenced.
3 Note that timing for AMI_ACK, AMI_RD, AMI_WR, and strobe timing parameters only applies to asynchronous access mode.
4 See Test Conditions on Page 55 for calculation of hold times given capacitive and dc loads.
5 For Write to Write: tSDCLK + H, for both same bank and different bank. For Write to Read: 3 × tSDCLK + H, for the same bank and different banks.
Figure 20. AMI Write
AMI_ACK
AMI_DATA
tDAWH
tDWHA
tWWR
tDATRWH
tDWHD
tWW
tDDWR
tDDWH
tDAWL
tWDE
tDSAK
tDAAK
AMI_RD
AMI_WR
AMI_ADDR
AMI_MSx
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