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参数资料
| 型号： | ADSP-BF532SBBZ400 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 33/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTLR 16BIT 400MHZ 169-BGA |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，UART |
| 时钟速率： | 400MHz |
| 非易失内存： | ROM（1 kB） |
| 芯片上RAM： | 84kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 169-BBGA |
| 供应商设备封装： | 169-PBGA（19x19） |
| 包装： | 托盘 |
| 配用： | ADZS-BF533-EZLITE-ND - KIT W/BOARD EVAL FOR ADSP-BF533 |
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ADSP-BF531 / ADSP-BF532 / ADSP-BF533
PPI_CLK
DATA
SAMPLED
FRAME SYNC
SAMPLED
t SFSPE
t HFSPE
t PCLKW
t PCLK
PPI_FS1/2
t SDRPE
t HDRPE
PPI_DATA
Figure 19. PPI GP Rx Mode with External Frame Sync Timing (PPI_CONTROL Bit 8 = 0)
PPI_CLK
FRAME SYNC
DRIVEN
DATA
DRIVEN
t PCLK
DATA
DRIVEN
PPI_FS1/2
t HOFSPE
t DFSPE
t DDTPE
t PCLKW
t HDTPE
PPI_DATA
Figure 20. PPI GP Tx Mode with Internal Frame Sync Timing
DATA DRIVEN /
FRAME SYNC SAMPLED
PPI_CLK
t SFSPE
t HFSPE
t PCLKW
t PCLK
PPI_FS1/2
t DDTPE
t HDTPE
PPI_DATA
Figure 21. PPI GP Tx Mode with External Frame Sync Timing (PPI_CONTROL Bit 8 = 1)
PPI_CLK
FRAME SYNC
SAMPLED
DATA
DRIVEN
t SFSPE
t HFSPE
t PCLKW
t PCLK
PPI_FS1/2
t DDTPE
t HDTPE
PPI_DATA
Figure 22. PPI GP Tx Mode with External Frame Sync Timing (PPI_CONTROL Bit 8 = 0)
Rev. I
|
Page 33 of 64 |
August 2013
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PDF描述 |
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