参数资料
| 型号： | ADUC816BCP |
| 厂商： | Analog Devices Inc |
| 文件页数： | 7/68页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8K FLASH ADC/DAC 56LFCSP |
| 标准包装： | 1 |
| 系列： | MicroConverter® ADuC8xx |
| 核心处理器： | 8052 |
| 芯体尺寸： | 8-位 |
| 速度： | 12.58MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | PSM，温度传感器，WDT |
| 输入/输出数： | 34 |
| 程序存储器容量： | 8KB（8K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 640 x 8 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 7x16b; D/A 1x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 56-VFQFN 裸露焊盘，CSP |
| 包装： | 托盘 |
| 产品目录页面： | 738 (CN2011-ZH PDF) |
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REV. 0
ADuC816
–15–
Parameter
Min
Typ
Max
Unit
Figure
SPI MASTER MODE TIMING (CPHA = 0)
tSL
SCLOCK Low Pulsewidth
*
630
ns
9
tSH
SCLOCK High Pulsewidth
*
630
ns
9
tDAV
Data Output Valid after SCLOCK Edge
50
ns
9
tDOSU
Data Output Setup before SCLOCK Edge
150
ns
9
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
9
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
9
tDF
Data Output Fall Time
10
25
ns
9
tDR
Data Output Rise Time
10
25
ns
9
tSR
SCLOCK Rise Time
10
25
ns
9
tSF
SCLOCK Fall Time
10
25
ns
9
*Characterized under the following conditions:
a. Core clock divider bits CD2, CD1 and CD0 bits in PLLCON SFR set to 0, 1, and 1 respectively, i.e., core clock frequency = 1.57 MHz and
b. SPI bit-rate selection bits SPR1 and SPR0 bits in SPICON SFR set to 0 and 0 respectively.
SCLOCK
(CPOL = 0)
t
DSU
SCLOCK
(CPOL = 1)
MOSI
MISO
MSB
LSB
LSB IN
BITS 6 – 1
MSB IN
t
DHD
t
DR
t
DAV
t
DF
t
DOSU
t
SH
t
SL
t
SR
t
SF
Figure 9. SPI Master Mode Timing (CPHA = 0)
REV. A
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