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参数资料
| 型号： | ADV3227ACPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 20/24页 |
| 文件大小： | 0K |
| 描述： | IC CROSSPOINT SW 16X16 100LFCSP |
| 标准包装： | 1 |
| 功能： | 交叉点开关 |
| 电路： | 1 x 16:16 |
| 电压电源： | 双电源 |
| 电压 - 电源，单路/双路(±)： | ±5V |
| 电流 - 电源： | 125mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 100ピンLFCSP-VQ（12x12） |
| 包装： | 管件 |
ADV3226/ADV3227
Rev. 0 | Page 5 of 24
TIMING CHARACTERISTICS (SERIAL)
Table 2.
Parameter
Symbol
Min
Typ
Max
Unit
Serial Data Setup Time
t1
10
ns
CLK Pulse Width
t2
10
ns
Serial Data Hold Time
t3
10
ns
CLK Pulse Separation, Serial Mode
t4
10
ns
CLK to UPDATE Delay
t5
10
ns
UPDATE Pulse Width
t6
10
ns
CLK to DATAOUT Valid, Serial Mode
t7
50
ns
Propagation Delay, UPDATE to Switch On or Off
20
ns
Data Load Time, CLK = 5 MHz, Serial Mode
1.6
μs
CLK, UPDATE Rise and Fall Times
50
ns
RESET Time
30
ns
Timing Diagram—Serial Mode
LOAD DATA INTO
SERIAL REGISTER
ON FALLING EDGE
t2
t4
1
0
1
0
DATAIN
CLK
1 = LATCHED
t1
t3
0 = TRANSPARENT
DATAOUT
OUT07 (D4)
OUT07 (D3)
OUT00 (D0)
TRANSFER DATA FROM SERIAL
REGISTER TO PARALLEL
LATCHES DURING LOW LEVEL
t7
t6
t5
UPDATE
08
65
3-
0
02
Figure 2. Timing Diagram, Serial Mode
LOGIC LEVELS
Table 3. Logic Levels
VIH
VIL
VOH
VOL
IIH
IIL
IIH
IIL
IOH
IOL
RESET, SER/PAR,
CLK, DATAIN,
CE, UPDATE
RESET,SER/PAR,
CLK, DATAIN,
CE, UPDATE
DATAOUT
SER/PAR,
CLK, DATAIN,
CE, UPDATE
SER/PAR, CLK,
DATAIN, CE,
UPDATE
RESET
DATAOUT
2.0 V min
0.8 V max
2.4 V min
0.4 V max
2 μA max
300 μA max
3 mA min
1 mA min
相关PDF资料 |
PDF描述 |
|---|---|
| ADV3224ACPZ | IC CROSSPOINT SW 16X8 72LFCSP |
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| ADV3229ACPZ | IC CROSSPOINT SW 16X8 72LFCSP |
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相关代理商/技术参数 |
参数描述 |
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| ADV32368102 | 制造商:LG Corporation 功能描述:Frame Assembly |
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