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参数资料
| 型号： | AGLN030V2-ZCSG81 |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 768 CLBS, 30000 GATES, 250 MHz, PBGA81 |
| 封装： | 5 X 5 MM, 0.8 MM HEIGHT, 0.5 MM PITCH, GREEN, CSP-81 |
| 文件页数： | 122/140页 |
| 文件大小： | 4325K |
| 代理商： | AGLN030V2-ZCSG81 |
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IGLOO nano DC and Switching Characteristics
2- 68
R e v i sio n 1 0
Table 2-97 AGLN020 Global Resource
Commercial-Case Conditions: TJ = 70°C, VCC = 1.14 V
Parameter
Description
Std.
Units
Min.1
Max.2
tRCKL
Input Low Delay for Global Clock
1.81
2.26
ns
tRCKH
Input High Delay for Global Clock
1.90
2.51
ns
tRCKMPWH
Minimum Pulse Width High for Global Clock
ns
tRCKMPWL
Minimum Pulse Width Low for Global Clock
ns
tRCKSW
Maximum Skew for Global Clock
0.61
ns
FRMAX
Maximum Frequency for Global Clock
MHz
Notes:
1. Value reflects minimum load. The delay is measured from the CCC output to the clock pin of a sequential element,
located in a lightly loaded row (single element is connected to the global net).
2. Value reflects maximum load. The delay is measured on the clock pin of the farthest sequential element, located in a fully
loaded row (all available flip-flops are connected to the global net in the row).
3. For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
Table 2-98 AGLN060 Global Resource
Commercial-Case Conditions: TJ = 70°C, VCC = 1.14 V
Parameter
Description
Std.
Units
Min.1
Max.2
tRCKL
Input Low Delay for Global Clock
2.02
2.42
ns
tRCKH
Input High Delay for Global Clock
2.09
2.65
ns
tRCKMPWH
Minimum Pulse Width High for Global Clock
ns
tRCKMPWL
Minimum Pulse Width Low for Global Clock
ns
tRCKSW
Maximum Skew for Global Clock
0.56
ns
FRMAX
Maximum Frequency for Global Clock
MHz
Notes:
1. Value reflects minimum load. The delay is measured from the CCC output to the clock pin of a sequential element,
located in a lightly loaded row (single element is connected to the global net).
2. Value reflects maximum load. The delay is measured on the clock pin of the farthest sequential element, located in a fully
loaded row (all available flip-flops are connected to the global net in the row).
3. For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
相关PDF资料 |
PDF描述 |
|---|---|
| AGLN030V2-ZQN48I | FPGA, 768 CLBS, 30000 GATES, 250 MHz, QCC48 |
| AGLN030V2-ZQN48 | FPGA, 768 CLBS, 30000 GATES, 250 MHz, QCC48 |
| AGLN030V2-ZQN68I | FPGA, 768 CLBS, 30000 GATES, 250 MHz, QCC68 |
| AGLN030V2-ZQN68 | FPGA, 768 CLBS, 30000 GATES, 250 MHz, QCC68 |
| AGLN030V2-ZQNG48I | FPGA, 768 CLBS, 30000 GATES, 250 MHz, QCC48 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| AGLN030V2-ZQNG48I | 功能描述:IC FPGA NANO 1KB 30K 48-QFN RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:IGLOO nano 标准包装:152 系列:IGLOO PLUS LAB/CLB数:- 逻辑元件/单元数:792 RAM 位总计:- 输入/输出数:120 门数:30000 电源电压:1.14 V ~ 1.575 V 安装类型:表面贴装 工作温度:-40°C ~ 85°C 封装/外壳:289-TFBGA，CSBGA 供应商设备封装:289-CSP（14x14） |
| AGLN030V2-ZQNG68 | 功能描述:IC FPGA NANO 1KB 30K 68-QFN RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:IGLOO nano 标准包装:152 系列:IGLOO PLUS LAB/CLB数:- 逻辑元件/单元数:792 RAM 位总计:- 输入/输出数:120 门数:30000 电源电压:1.14 V ~ 1.575 V 安装类型:表面贴装 工作温度:-40°C ~ 85°C 封装/外壳:289-TFBGA，CSBGA 供应商设备封装:289-CSP（14x14） |
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