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参数资料
型号： AGLN030V2-ZCSG81
元件分类： FPGA
英文描述： FPGA, 768 CLBS, 30000 GATES, 250 MHz, PBGA81
封装： 5 X 5 MM, 0.8 MM HEIGHT, 0.5 MM PITCH, GREEN, CSP-81
文件页数： 134/140页
文件大小： 4325K
代理商： AGLN030V2-ZCSG81
IGLOO nano Low Power Flash FPGAs
Re vi s i on 10
2 - 79
1.2 V DC Core Voltage
Table 2-105 RAM4K9
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.14 V
Parameter
Description
Std.
Units
tAS
Address setup time
1.28
ns
tAH
Address hold time
0.25
ns
tENS
REN_B, WEN_B setup time
1.25
ns
tENH
REN_B, WEN_B hold time
0.25
ns
tBKS
BLK_B setup time
2.54
ns
tBKH
BLK_B hold time
0.25
ns
tDS
Input data (DI) setup time
1.10
ns
tDH
Input data (DI) hold time
0.55
ns
tCKQ1
Clock HIGH to new data valid on DO (output retained, WMODE = 0)
5.51
ns
Clock HIGH to new data valid on DO (flow-through, WMODE = 1)
4.77
ns
tCKQ2
Clock HIGH to new data valid on DO (pipelined)
2.82
ns
tC2CWWL
Address collision clk-to-clk delay for reliable write after write on same address;
applicable to closing edge
0.30
ns
tC2CRWH
Address collision clk-to-clk delay for reliable read access after write on same address;
applicable to opening edge
0.89
ns
tC2CWRH
Address collision clk-to-clk delay for reliable write access after read on same address;
applicable to opening edge
1.01
ns
tRSTBQ
RESET_B LOW to data out LOW on DO (flow-through)
3.21
ns
RESET_B LOW to data out LOW on DO (pipelined)
3.21
ns
tREMRSTB
RESET_B removal
0.93
ns
tRECRSTB
RESET_B recovery
4.94
ns
tMPWRSTB
RESET_B minimum pulse width
1.18
ns
tCYC
Clock cycle time
10.90
ns
FMAX
Maximum frequency
92
MHz
Note:
For specific junction temperature and voltage supply levels, refer to Table 2-7 on page 2-7 for derating values.
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PDF描述
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AGLN030V2-ZQNG48I 功能描述:IC FPGA NANO 1KB 30K 48-QFN RoHS:是 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:IGLOO nano 标准包装:152 系列:IGLOO PLUS LAB/CLB数:- 逻辑元件/单元数:792 RAM 位总计:- 输入/输出数:120 门数:30000 电源电压:1.14 V ~ 1.575 V 安装类型:表面贴装 工作温度:-40°C ~ 85°C 封装/外壳:289-TFBGA，CSBGA 供应商设备封装:289-CSP（14x14）
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