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参数资料
| 型号： | AM29DS323DT120 |
| 厂商： | Advanced Micro Devices, Inc. |
| 英文描述： | 32 Megabit (4 M x 8-Bit/2 M x 16-Bit) CMOS 1.8 Volt-only, Simultaneous Operation Flash Memory |
| 中文描述： | 32兆位（4个M × 8位/ 2米x 16位），1.8伏的CMOS只，同时作业快闪记忆体 |
| 文件页数： | 40/54页 |
| 文件大小： | 1013K |
| 代理商： | AM29DS323DT120 |
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44
Am29DS323D
P R E L I M I NARY
AC CHARACTERISTICS
Data Polling and Toggle Bit
Notes:
1. Not 100% tested.
Parameter
Description
Test Setup
All Speed
Options
JEDEC
Std
Unit
t
AVAV
t
RC
Read Cycle Time (Note 1)
Min
200
ns
t
AVQV
t
ACC
Address to Output Delay
CE#, OE# = V
IL
Max
200
ns
t
ELQV
t
CE
Chip Enable to Output Delay
OE# = V
IL
Max
200
ns
t
GLQV
t
OE
Output Enable to Output Delay
Max
50
ns
t
EHQZ
t
DF
Chip Enable to Output High Z (Note 1)
Max
16
ns
t
GHQZ
t
DF
Output Enable to Output High Z (Note 1)
Max
16
ns
t
AXQX
t
OH
Output Hold Time From Addresses, CE# or OE#,
Whichever Occurs First
Min
0
ns
t
OEH
Output Enable Hold
Time (Note 1)
Data Polling
and Toggle Bit
Min
10
ns
WE#
CE#
OE#
High Z
tOE
High Z
DQ7
DQ0–DQ6
RY/BY#
tBUSY
Complement
True
Addresses
VA
tOEH
tCE
tCH
tOH
tDF
VA
Status Data
Complement
Status Data
True
Valid Data
tACC
tRC
Note: VA = Valid address. Illustration shows first status cycle after command sequence, last status read cycle, and array data
read cycle.
Figure 21.
Data# Polling Timings (During Embedded Algorithms)
相关PDF资料 |
PDF描述 |
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