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参数资料
| 型号： | AT40KEL040KZ1SB |
| 厂商： | ATMEL CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 2304 CLBS, 50000 GATES, PQFP256 |
| 封装： | MQFP-256 |
| 文件页数： | 21/42页 |
| 文件大小： | 670K |
| 代理商： | AT40KEL040KZ1SB |
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28
AT40KEL040
4155G–AERO–05/05
AC Timing
Characteristics
Cell Function
Parameter
Path
Value
Units
Notes
Async RAM
Write
t
WECYC (min)
cycle time
28
ns
Write
t
WEL (min)
we
6.5
ns
pulse width low
Write
t
WEH (min)
we
6.5
ns
pulse width high
Write
t
setup (min)
wr addr setup -> we
7.0
ns
Write
t
hold (min)
wr addr hold -> we
0.0
ns
Write
t
setup (min)
din setup -> we
6.5
ns
Write
t
hold (min)
din hold -> we
0.0
ns
Write
t
hold (min)
oe hold -> we
0.0
ns
Write/Read
t
PD (max)
din -> dout
14.1
ns
rd addr = wr addr
Read
t
PD (max)
rd addr -> dout
13.1
ns
Read
t
PZX (max)
oe -> dout
4.5
ns
Read
t
PXZ (max)
oe -> dout
4.5
ns
Sync RAM
Write
t
CYC (min)
cycle time
28
ns
Write
t
CLKL (min)
clk
6.5
ns
pulse width low
Write
t
CLKH (min)
clk
6.5
ns
pulse width high
Write
t
setup (min)
we setup -> clk
5.0
ns
Write
t
hold (min)
we hold -> clk
0.0
ns
Write
t
setup (min)
wr addr setup -> clk
6.5
ns
Write
t
hold (min)
wr addr hold -> clk
0.0
ns
Write
t
setup (min)
wr data setup -> clk
5.1
ns
Write
t
hold (min)
wr data hold -> clk
0.0
ns
Write/Read
t
PD (max)
din -> dout
14.1
ns
rd addr = wr addr
Write/Read
t
PD (max)
clk -> dout
7.9
ns
rd addr = wr addr
Read
t
PD (max)
rd addr -> dout
13.1
ns
Read
t
PZX (max)
oe -> dout
4.5
ns
Read
t
PXZ (max)
oe -> dout
4.5
ns
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