参数资料
| 型号： | AT90S8515-8PC |
| 厂商： | Atmel |
| 文件页数： | 52/112页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8K FLSH 8MHZ 40DIP |
| 标准包装： | 18 |
| 系列： | AVR® 90S |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 8MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 8KB（4K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 6 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 包装： | 管件 |
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44
AT90S8515
0841G–09/01
EEPROM Read/Write
Access
The EEPROM access registers are accessible in the I/O space.
The write access time is in the range of 2.5 - 4 ms, depending on the V
CC voltages. A
self-timing function, however, lets the user software detect when the next byte can be
written. If the user code contains code that writes the EEPROM, some precaution must
be taken. In heavily filtered power supplies, V
CC is likely to rise or fall slowly on power-
up/down. This causes the device for some period of time to run at a voltage lower than
specified as minimum for the clock frequency used. CPU operation under these condi-
tions is likely cause the program counter to perform unintentional jumps and eventually
execute the EEPROM write code. To secure EEPROM integrity, the user is advised to
use an external under-voltage reset circuit in this case.
In order to prevent unintentional EEPROM writes, a specific write procedure must be fol-
lowed. Refer to the description of the EEPROM Control Register for details on this.
When the EEPROM is written, the CPU is halted for two clock cycles before the next
instruction is executed. When the EEPROM is read, the CPU is halted for four clock
cycles before the next instruction is executed.
EEPROM Address Register –
EEARH and EEARL
The EEPROM address registers (EEARH and EEARL) specify the EEPROM address in
the 512-byte EEPROM space for AT90S8515. The EEPROM data bytes are addressed
linearly between 0 and 512.
EEPROM Data Register –
EEDR
Bits 7..0 – EEDR7..0: EEPROM Data
For the EEPROM write operation, the EEDR register contains the data to be written to
the EEPROM in the address given by the EEAR register. For the EEPROM read opera-
tion, the EEDR contains the data read out from the EEPROM at the address given by
EEAR.
EEPROM Control Register –
EECR
Bits 7..3 – Res: Reserved Bits
These bits are reserved bits in the AT90S8515 and will always read as zero.
Bit
1514
13
1211
10
9
8
$1F ($3F)
–––
–
EEAR8
EEARH
$1E ($3E)
EEAR7
EEAR6
EEAR5
EEAR4
EEAR3
EEAR2
EEAR1
EEAR0
EEARL
765
432
10
Read/Write
RR
RRR
RR
R/W
Initial Value
0
000
00
Bit
765
432
10
$1D ($3D)
MSB
LSB
EEDR
Read/Write
R/W
Initial Value
0
Bit
7
65
43
2
1
0
$1C ($3C)
–
EEMWE
EEWE
EERE
EECR
Read/Write
R
R/W
Initial Value
0
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