参数资料
| 型号： | AT90S8515-8PC |
| 厂商： | Atmel |
| 文件页数： | 71/112页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8K FLSH 8MHZ 40DIP |
| 标准包装： | 18 |
| 系列： | AVR® 90S |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 8MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 8KB（4K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4 V ~ 6 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 40-DIP（0.600"，15.24mm） |
| 包装： | 管件 |
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AT90S8515
0841G–09/01
Default, the external SRAM access, is a 3-cycle scheme as depicted in Figure 43. When
one extra wait state is needed in the access cycle, set the SRW bit (one) in the MCUCR
register. The resulting access scheme is shown in Figure 44. In both cases, note that
PORTA is data bus in one cycle only. As soon as the data access finishes, PORTA
becomes a low-order address bus again.
view” on page 7 for a description of the memory map, including address space for
SRAM.
Figure 42. External SRAM Connected to the AVR
Figure 43. External Data SRAM Memory Cycles without Wait State
D[7:0]
A[7:0]
A[15:8]
RD
WR
SRAM
DQ
G
Port A
ALE
Port C
RD
WR
AVR
System Clock
ALE
WR
RD
Data/Address [7..0]
Address [15..8]
Address
T1
T2
T3
Prev. Address
Data
Wr
it
e
R
e
a
d
Address
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PDF描述 |
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参数描述 |
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