参数资料
| 型号： | ATTINY26L-8PU |
| 厂商： | Atmel |
| 文件页数： | 166/169页 |
| 文件大小： | 0K |
| 描述： | IC MCU AVR 2K 5V 8MHZ 20-DIP |
| 产品培训模块： | MCU Product Line Introduction tinyAVR Introduction |
| 标准包装： | 18 |
| 系列： | AVR® ATtiny |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 8MHz |
| 连通性： | USI |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 16 |
| 程序存储器容量： | 2KB（1K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 128 x 8 |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 11x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
| 产品目录页面： | 612 (CN2011-ZH PDF) |
| 配用： | ATSTK600-RC08-ND - STK600 ROUTING CARD AVR ATSTK600-ND - DEV KIT FOR AVR/AVR32 ATAVRISP2-ND - PROGRAMMER AVR IN SYSTEM ATSTK505-ND - ADAPTER KIT FOR 14PIN AVR MCU |
| 其它名称： | ATTINY26L-8PJ ATTINY26L-8PJ-ND |
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1477K–AVR–08/10
ATtiny26(L)
stage will saturate at 0V (GND). This amplified value then becomes the analog input to the ADC.
If single ended channels are used, the gain amplifier is bypassed altogether.
The ADC can operate in two modes – Single Conversion and Free Running mode. In Single
Conversion mode, each conversion will have to be initiated by the user. In Free Running mode,
the ADC is constantly sampling and updating the ADC Data Register. The ADFR bit in ADCSR
selects between the two available modes.
The ADC is enabled by setting the ADC Enable bit, ADEN in ADCSR. Voltage reference and
input channel selections will not go into effect until ADEN is set. The ADC does not consume
power when ADEN is cleared, so it is recommended to switch off the ADC before entering power
saving sleep modes.
A conversion is started by writing a logical one to the ADC Start Conversion bit, ADSC. This bit
stays high as long as the conversion is in progress and will be set to zero by hardware when the
conversion is completed. If a different data channel is selected while a conversion is in progress,
the ADC will finish the current conversion before performing the channel change.
The ADC generates a 10-bit result, which is presented in the ADC Data Registers, ADCH and
ADCL. By default, the result is presented right adjusted, but can optionally be presented left
adjusted by setting the ADLAR bit in ADMUX.
If the result is left adjusted and no more than 8-bit precision is required, it is sufficient to read
ADCH. Otherwise, ADCL must be read first, then ADCH, to ensure that the content of the data
registers belongs to the same conversion. Once ADCL is read, ADC access to data registers is
blocked. This means that if ADCL has been read, and a conversion completes before ADCH is
read, neither register is updated and the result from the conversion is lost. When ADCH is read,
ADC access to the ADCH and ADCL Registers is re-enabled.
The ADC has its own interrupt which can be triggered when a conversion completes. When ADC
access to the Data Registers is prohibited between reading of ADCH and ADCL, the interrupt
will trigger even if the result is lost.
Prescaling and
Conversion
Timing
Figure 52. ADC Prescaler
The successive approximation circuitry requires an input clock frequency between 50 kHz and
200 kHz. If a lower resolution than 10 bits is needed, the input clock frequency to the ADC can
be as high as 1000 kHz to get a higher sample rate.
7-BIT ADC PRESCALER
ADC CLOCK SOURCE
CK
ADPS0
ADPS1
ADPS2
CK/128
CK/2
CK/4
CK/8
CK/16
CK/32
CK/64
Reset
ADEN
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参数描述 |
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| ATTINY26L-8SUR | 功能描述:8位微控制器 -MCU 2K FL 128B EE 128B SRAM ADC 8MHZ IND 3V RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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