参数资料
| 型号： | ATTINY26L-8PU |
| 厂商： | Atmel |
| 文件页数： | 86/169页 |
| 文件大小： | 0K |
| 描述： | IC MCU AVR 2K 5V 8MHZ 20-DIP |
| 产品培训模块： | MCU Product Line Introduction tinyAVR Introduction |
| 标准包装： | 18 |
| 系列： | AVR® ATtiny |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 8MHz |
| 连通性： | USI |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 16 |
| 程序存储器容量： | 2KB（1K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 128 x 8 |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 11x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
| 产品目录页面： | 612 (CN2011-ZH PDF) |
| 配用： | ATSTK600-RC08-ND - STK600 ROUTING CARD AVR ATSTK600-ND - DEV KIT FOR AVR/AVR32 ATAVRISP2-ND - PROGRAMMER AVR IN SYSTEM ATSTK505-ND - ADAPTER KIT FOR 14PIN AVR MCU |
| 其它名称： | ATTINY26L-8PJ ATTINY26L-8PJ-ND |
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1477K–AVR–08/10
ATtiny26(L)
System Clock
and Clock
Options
Clock Systems
and their
Distribution
Figure 20 presents the principal clock systems in the AVR and their distribution. All of the clocks
need not be active at a given time. In order to reduce power consumption, the clocks to modules
not being used can be halted by using different sleep modes, as described in “Power Manage-
ment and Sleep Modes” on page 37. The clock systems are detailed below.
Figure 20. Clock Distribution
CPU Clock – clkCPU
The CPU clock is routed to parts of the system concerned with operation of the AVR core.
Examples of such modules are the General Purpose Register File, the Status Register and the
data memory holding the Stack Pointer. Halting the CPU clock inhibits the core from performing
general operations and calculations.
I/O Clock – clkI/O
The I/O clock is used by the majority of the I/O modules, like Timer/Counters, and USI. The I/O
clock is also used by the External Interrupt module, but note that some external interrupts are
detected by asynchronous logic, allowing such interrupts to be detected even if the I/O clock is
halted.
Flash Clock – clkFLASH The Flash clock controls operation of the Flash interface. The Flash clock is usually active simul-
taneously with the CPU clock.
ADC Clock – clkADC
The ADC is provided with a dedicated clock domain. This allows halting the CPU and I/O clocks
in order to reduce noise generated by digital circuitry. This gives more accurate ADC conversion
results.
General I/O
modules
Timer/Counter1
ADC
CPU Core
RAM
clk
I/O
AVR Clock
Control Unit
clk
CPU
Flash and
EEPROM
clk
FLASH
clk
ADC
Source clock
Watchdog Timer
Watchdog
Oscillator
Reset Logic
Clock
Multiplexer
Watchdog clock
Calibrated RC
Oscillator
PLL
Crystal
Oscillator
Low-Frequency
Crystal Oscillator
External RC
Oscillator
clk
PLL
clk
PCK
External clock
相关PDF资料 |
PDF描述 |
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| ATTINY44A-MFR | MCU AVR 4KB FLASH 20MHZ 20QFN |
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参数描述 |
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| ATTINY26L-8SUR | 功能描述:8位微控制器 -MCU 2K FL 128B EE 128B SRAM ADC 8MHZ IND 3V RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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