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参数资料
| 型号： | CS4265-DNZR |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 28/46页 |
| 文件大小： | 0K |
| 描述： | IC CODEC 24BIT 104DB 32-QFN |
| 标准包装： | 6,000 |
| 类型： | 立体声音频 |
| 数据接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 数量： | 2 / 2 |
| 三角积分调变： | 是 |
| 动态范围，标准 ADC / DAC (db)： | 104 / 104 |
| 电压 - 电源，模拟： | 3.13 V ~ 5.25 V |
| 电压 - 电源，数字： | 3.13 V ~ 5.25 V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-QFN |
| 供应商设备封装： | 32-QFN 裸露焊盘（5x5） |
| 包装： | 带卷 (TR) |
| 配用： | 598-1001-ND - BOARD EVAL FOR CS4265 CODEC |
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34
DS657F3
CS4265
5. REGISTER QUICK REFERENCE
This table shows the register names and their associated default values.
Addr
Function
7
6
5
4
3
2
1
0
01h Chip ID
PART3
PART2
PART1
PART0
REV3
REV2
REV1
REV0
1
0
1
000
1
02h Power Control
Freeze
Reserved Reserved Reserved
PDN_MIC
PDN_ADC
PDN_DAC
PDN
0
000
1
03h DAC Control 1 Reserved Reserved DAC_DIF1 DAC_DIF0 Reserved
MuteDAC
DeEmph
Reserved
0
100
0
04h ADC Control
FM1
FM0
Reserved ADC_DIF
Reserved
MuteADC
HPFFreeze
M/S
0
000
0
05h MCLK
Frequency
Reserved
MCLK
Freq2
MCLK
Freq1
MCLK
Freq0
Reserved
0
000
0
06h Signal Selec-
tion
SDINSel Reserved Reserved Reserved
Reserved
LOOP
Reserved
0
1
0
000
0
07h PGA Ch B
Gain Control
Reserved Reserved
Gain5
Gain4
Gain3
Gain2
Gain1
Gain0
0
000
0
08h PGA Ch A
Gain Control
Reserved Reserved
Gain5
Gain4
Gain3
Gain2
Gain1
Gain0
0
000
0
09h Analog Input
Control
Reserved Reserved Reserved PGASoft
PGAZero
Reserved
Select
0
1
100
1
0Ah DAC Ch A Vol-
ume Control
Vol7
Vol6
Vol5
Vol4
Vol3
Vol2
Vol1
Vol0
0
000
0
0Bh DAC Ch B Vol-
ume Control
Vol7
Vol6
Vol5
Vol4
Vol3
Vol2
Vol1
Vol0
0
000
0
0Ch DAC Control 2 DACSoft DACZero InvertDAC Reserved
Reserved
1
0
000
0
0Dh Status
Reserved Reserved Reserved
EFTC
ClkErr
Reserved
ADCOvfl
ADCUndrfl
0
000
0
0Eh Status Mask
Reserved Reserved Reserved
EFTCM
ClkErrM
Reserved
ADCOvflM ADCUndrflM
0
000
0
0Fh Status Mode
MSB
Reserved Reserved Reserved
EFTC1
ClkErr1
Reserved
ADCOvfl1 ADCUndrfl1
0
000
0
10h Status Mode
LSB
Reserved Reserved Reserved
EFTC0
ClkErr0
Reserved
ADCOvfl0 ADCUndrfl0
0
000
0
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