参数资料
型号: CS42L51-CNZR
厂商: Cirrus Logic Inc
文件页数: 14/43页
文件大小: 0K
描述: IC CODEC LOW-V 24BIT 32-QFP
标准包装: 6,000
类型: 立体声音频
数据接口: PCM 音频接口
分辨率(位): 24 b
ADC / DAC 数量: 2 / 2
三角积分调变:
动态范围,标准 ADC / DAC (db): 98 / 98
电压 - 电源,模拟: 1.8V,2.5V
电压 - 电源,数字: 1.8V,2.5V
工作温度: -10°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 32-QFP
供应商设备封装: 32-QFN 裸露焊盘(5x5)
包装: 管件
配用: 598-1005-ND - BOARD EVAL FOR CS42L51 CODEC
其它名称: Q3956082
DS679F1
21
CS42L51
14. After powering up the CS42L51, RESET should be held low after the power supplies and clocks are
settled.
15. See “Example System Clock Frequencies” on page 79 for typical MCLK frequencies.
16. See
18. “MCLK” refers to the external master clock applied.
Master Mode (Note 17)
Output Sample Rate (LRCK)
All Speed Modes
Fs
-Hz
LRCK Duty Cycle
45
55
%
SCLK Frequency
1/tP
-
64Fs
Hz
SCLK Duty Cycle
45
55
%
LRCK Edge to SDOUT MSB Output Delay
td(MSB)
-52
ns
SDOUT Setup Time Before SCLK Rising Edge
ts(SDO-SK)
20
-
ns
SDOUT Hold Time After SCLK Rising Edge
th(SK-SDO)
30
-
ns
SDIN Setup Time Before SCLK Rising Edge
ts(SD-SK)
20
-
ns
SDIN Hold Time After SCLK Rising Edge
th
20
-
ns
Parameters
Symbol
Min
Max
Units
MCLK
128
-----------------
th(SK-SDO)
//
ts(SD-SK)
MSB
MSB-1
LRCK
SCLK
SDOUT
SDIN
td(MSB)
ts(LK-SK)
tP
th
ts(SDO-SK)
Figure 4. Serial Audio Interface Slave Mode Timing
th(SK-SDO)
//
ts(SD-SK)
MSB
MSB-1
LRCK
SCLK
SDOUT
SDIN
td(MSB)
tP
th
ts(SDO-SK)
Figure 5. Serial Audio Interface Master Mode Timing
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