参数资料
型号: CS4351-DZZ
厂商: Cirrus Logic Inc
文件页数: 9/37页
文件大小: 0K
描述: IC DAC STER 112DB 192KHZ 20TSSOP
标准包装: 74
位数: 24
数据接口: 串行
转换器数目: 2
电压电源: 模拟和数字
功率耗散(最大): 354mW
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 20-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 20-TSSOP
包装: 托盘
输出数目和类型: 2 电压,单极
采样率(每秒): 192k
配用: 598-1152-ND - BOARD EVAL FOR CS4351 DAC
DS566F1
17
CS4351
least 32 cycles per LRCK period in format 2, 48 cycles in format 3, 40 cycles in format 4, and 36 cycles
in format 5.
4.4
De-Emphasis Control
The device includes on-chip digital de-emphasis. Figure 8 shows the de-emphasis curve for Fs equal to 44.1
kHz. The frequency response of the de-emphasis curve will scale proportionally with changes in sample
rate, Fs.
Note:
De-emphasis is only available in Single-Speed Mode.
LR C K
SC L K
Left C ha nnel
Righ t C ha n nel
SDIN
+3 +2 +1
+5 +4
MSB
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
-1 -2 -3 -4
LSB
MSB
LSB
Figure 5. Left-Justified up to 24-Bit Data
LR C K
SCL K
Left C ha nnel
Rig h t Channel
SDIN
+3 +2 +1
+5 +4
MSB
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
-1 -2 -3 -4
MSB
LSB
Figure 6. IS, up to 24-Bit Data
LRCK
SCLK
Left Chan ne l
SDIN
-6 -5 -4 -3 -2 -1
-7
+1 +2 +3 +4 +5
MSB
R ight Cha nne l
LSB
MSB
+1 +2 +3 +4 +5
LSB
-6 -5 -4 -3 -2 -1
-7
MSB
Figure 7. Right-Justified Data
Gain
dB
-10dB
0dB
Frequency
T2 = 15 s
T1=50 s
F1
F2
3.183 kHz
10.61 kHz
Figure 8. De-Emphasis Curve
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PDF描述
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