参数资料
| 型号： | CS4391A-KZZ |
| 厂商： | Cirrus Logic Inc |
| 文件页数： | 3/40页 |
| 文件大小： | 0K |
| 描述： | IC DAC 24BIT 192KHZ W/VC 20TSSOP |
| 标准包装： | 74 |
| 位数： | 24 |
| 数据接口： | 串行 |
| 转换器数目： | 2 |
| 电压电源： | 模拟和数字 |
| 功率耗散（最大）： | 175mW |
| 工作温度： | -10°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 输出数目和类型： | 4 电压，单极 |
| 采样率（每秒）： | 192k |
| 其它名称： | 598-1064-5 |
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CS4391A
DS600PP3
11
SWITCHING CHARACTERISTICS - I2C CONTROL PORT (Inputs: logic 0 = AGND,
logic 1 = VL)
Notes: 7. Data must be held for sufficient time to bridge the 300 ns transition time of SCL.
Parameter
Symbol
Min
Max
Unit
I2C Mode
SCL Clock Frequency
fscl
-100
KHz
RST Rising Edge to Start
tirs
500
-
ns
Bus Free Time Between Transmissions
tbuf
4.7
-
s
Start Condition Hold Time (prior to first clock pulse)
thdst
4.0
-
s
Clock Low time
tlow
4.7
-
s
Clock High Time
thigh
4.0
-
s
Setup Time for Repeated Start Condition
tsust
4.7
-
s
SDA Hold Time from SCL Falling
(Note 7)
thdd
0-
s
SDA Setup time to SCL Rising
tsud
250
-
ns
Rise Time of Both SDA and SCL Lines
tr
-1
s
Fall Time of Both SDA and SCL Lines
tf
-
300
ns
Setup Time for Stop Condition
tsusp
4.7
-
s
t
buf
t
hdst
t
hdst
t
lo w
t r
t f
t
hdd
t high
t sud
t sust
t susp
Stop
S tart
Sta rt
Stop
Re pe ate d
SD A
SC L
t
irs
RS T
Figure 3. I2C Control Port Timing
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PDF描述 |
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