参数资料
| 型号： | DS1862AB+ |
| 厂商： | Maxim Integrated |
| 文件页数： | 26/42页 |
| 文件大小： | 0K |
| 描述： | IC LASR CTRLR 7CHAN 5.5V 25CSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 126 |
| 类型： | 激光二极管控制器（光纤） |
| 数据速率： | 10Gbps |
| 通道数： | 7 |
| 电源电压： | 2.9 V ~ 5.5 V |
| 电流 - 电源： | 3mA |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 25-TFBGA，CSPBGA |
| 供应商设备封装： | 25-BGA（5x5） |
| 包装： | 管件 |
| 安装类型： | 表面贴装 |
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XFP Laser Control and Digital Diagnostic IC
LOWER MEMORY (00h–7Fh)
ADDRESS
WORD 0
WORD 1
WORD 2
WORD 3
(hex)
BYTE 0/8
BYTE 1/9
BYTE 2/A
BYTE 3/B
BYTE 4/C
BYTE 5/D
BYTE 6/E
BYTE 7/F
00 <0,2>
USER EE
Signal Cond*
Temp Alarm Hi
Temp Alarm Lo
Temp Warn Hi
08 <2>
10 <2>
18 <2>
20 <2>
28 <2>
30 <2>
Temp Warn Lo
V CC3 Warn Lo**
Bias Warn Lo
TX-P Warn Lo
RX-P Warn Lo
AUX1 Warn Lo
V CC3 Alarm Hi**
Bias Alarm Hi
TX-P Alarm Hi
RX-P Alarm Hi
AUX1 Alarm Hi
AUX2 Alarm Hi
V CC3 Alarm Lo**
Bias Alarm Lo
TX-P Alarm Lo
RX-P Alarm Lo
AUX1 Alarm Lo
AUX2 Alarm Lo
V CC3 Warn Hi**
Bias Warn Hi
TX-P Warn Hi
RX-P Warn Hi
AUX1 Warn Hi
AUX2 Warn Hi
38 <0,2>
AUX2 Warn Lo
USER EE
USER EE
Reserved
Reserved
Reserved
Reserved
40 <1>
48 <1>
Reserved
USER SRAM
Reserved
USER SRAM
Reserved
USER SRAM
Reserved
USER SRAM
Reserved
USER SRAM
Reserved
USER SRAM
USER SRAM
USER SRAM
USER SRAM
USER SRAM
50 <1>
Temp/Res/Bias/ RxP/AUX1/AUX2/ Temp/Res/Bias/
TxP Alarm Res Alarm TxP Warn
RxP/AUX1/
AUX2/Res Warn
Tx/Rx Misc
Flags
Apd/Tec/ V CC5/3/2 /Vee
Wave/Res Flags Alarm Flags
V CC5/3/2 /Vee
Warn Flags
58 <1>
Temp/Res/Bias/ RxP/AUX1/AUX2/ Temp/Res/Bias/
TxP Mask Res Mask TxP Mask
RxP/AUX1/
AUX2/Res Mask
Rx/Rx Misc Apd/Tec/Wave/
Mask Res Mask
V CC5/3/2/ Vee
Alarm Mask
V CC5/3/2 /Vee
Warn Mask
60 <1>
Temp Value
V CC2/3 Value**
Bias Value
TX-P Value
68 <1>
RX-P Value
AUX1 Value AUX2 Value GCS1
GCS0
70 <0,1>
Reserved Reserved
Reserved Reserved
POA
Reserved
PEC_EN
Host PW
78 <0,1>
Host PW Host PW
Host PW PWE (MSB) PWE (LSB)
Table Select
EXPANDED BYTES
BYTE
BYTE/WORD
Bit7
Bit6*
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
(hex)
NAME
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
01
50
51
Signal Cond <1> *
<1>
<1>
USER EE
L-HI-TEMP-
AL
L-HI-RX-P-
AL
USER EE
L-LO-TEMP-
AL
L-LO-RX-P-
AL
USER EE
Reserved
L-HI-AUX1-
AL
USER EE
Reserved
L-LO-AUX1-
AL
USER EE
L-HI-BIAS-
AL
L-HI-AUX2-
AL
EN2 Value
L-LO-BIAS-
AL
L-LO-AUX2-
AL
EN1 Value
L-HI-TX-P-
AL
Reserved
Lock-T1-221
L-LO-TX-
P-AL
Reserved
52
<1>
L-HI-TEMP-
W
L-LO-TEMP-
W
Reserved
Reserved
L-HI-BIAS-W L-LO-BIAS-W L-HI-TX-P-W L-LO-TX-P-W
53
54
55
56
<1>
<1>
<1>
<1>
L-HI-RX-P-W
L-TX-NR
L-APD-SUP-F
L-HI-V CC5 -
AL
L-LO-RX-P-
W
L-TX-F
L-TEC-F
L-LO–V CC5-
AL
L-HI-AUX1-
W
L-TX-CDR-
NL
L-WAVE-NL
L-HI-V CC3 -
AL
L-LO-AUX1-
W
L-RX-NR
Reserved
L-LO–V CC3 -
AL
L-HI-AUX2-
W
L-RX-LOS
Reserved
L-HI-V CC2 -
AL
L-LO-AUX2-
W
L-RX-CDR-
NL
Reserved
L-LO–V CC2-
AL
Reserved
L-MOD-NR
Reserved
L-HI-V EE5 -
AL
Reserved
L-RESET-
DONE
Reserved
L-LO-V EE5 -
AL
*Bit 0 of Address 01h can be written only if bit 0 of Byte DDh in Table 01h is set.
**V CC2/3 are in reserved locations.
26
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