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参数资料
| 型号： | DS26334GN |
| 英文描述： | 3.3V, 16-Channel, E1/T1/J1 Short and Long-Haul Line Interface Unit |
| 中文描述： | 3.3伏，16路，E1/T1/J1短，长途线路接口单元 |
| 文件页数： | 56/115页 |
| 文件大小： | 756K |
| 代理商： | DS26334GN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页当前第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页
DS26334 3.3V, 16-Channel, E1/T1/J1 Short/Long-Haul Line Interface Unit
56 of 115
Register Address (LIUs 9-16):
Bit #
Name
Default
Bit 6: AIS Enable During Loss (AISEL)
. When this bit is set, an AIS is sent to the System Side upon detecting
LOS for each channel. The individual LIU Register
IAISEL
settings will be ignored when this bit is set. When reset,
the
IAISEL
register will have control.
2Fh
7
—
0
6
5
4
3
2
—
0
1
0
AISEL
0
SCPD
0
CODE
0
JADS
0
JAPS
0
JAE
0
Bit 5: Short Circuit Protection Disable (SCPD).
If this bit is set the Short Circuit protection is disabled for all the
transmitters. The individual LIU Register
ISCPD
settings will be ignored when this bit is set. When reset, the
ISCPD
register will have control.
Bit 4: Code.
If this bit is set AMI encoder/decoder is selected. The
LCS
register settings will be ignored when this
bit is set. If reset, the
LCS
register will have control.
Bit 3: Jitter Attenuator Depth Select (JADS)
. If this bit is set the jitter attenuator FIFO depth is 128 bits. The
settings in the
IJAFDS
register will be ignored if this register is set. If reset the
IJAFDS
register will have control.
Bit 1: Jitter Attenuator Position Select (JAPS).
When the JAPS bit is set high, the JA will be in the Receive path
and when default or set low in the Transmit path. These settings can be changed for an individual LIU by settings in
Register
IJAPS
. Note that when bit JAE is set, the settings in Register
IJAPS
will be ignored.
Bit 0: Jitter Attenuator Enable (JAE).
When this bit is set the JA is enabled. The settings in the
IJAE
register will
be ignored if this register is set. If reset, the IJAE register will have control.
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