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参数资料
| 型号： | DS26503 |
| 厂商： | Maxim Integrated Products, Inc. |
| 英文描述： | T1/E1/J1/64KCC BITS Element |
| 中文描述： | T1/E1/J1 BITS单元 |
| 文件页数： | 48/123页 |
| 文件大小： | 995K |
| 代理商： | DS26503 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页当前第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页
DS26503 T1/E1/J1 BITS Element
48 of 123
9.2 E1 Information Registers
Register Name:
Register Description:
Register Address:
Bit #
7
Name
—
Default
0
HW
Mode
Bit 0/CAS Resync Criteria Met Event (CASRC).
Set when two consecutive CAS MF alignment words are received in error.
Bit 1/FAS Resync Criteria Met Event (FASRC.
Set when three consecutive FAS words are received in error.
Bit 2/CRC Resync Criteria Met Event (CRCRC).
Set when 915/1000 codewords are received in error.
Bit 3/Unused.
Bit 4/Unused.
Bit 5/Unused.
Bit 6/Unused.
Bit 7/Unused.
Register Name:
INFO3
Register Description:
Information Register 3 (Real Time)
Register Address:
1Ch
Bit #
7
6
5
4
Name
CSC5
CSC4
CSC3
CSC2
CSC0
Default
0
0
0
0
HW
Mode
Bit 0/CRC4 MF Sync Active (CRC4SA).
Set while the synchronizer is searching for the CRC4 MF alignment word.
Bit 1/CAS MF Sync Active (CASSA).
Set while the synchronizer is searching for the CAS MF alignment word.
Bit 2/FAS Sync Active (FASSA).
Set while the synchronizer is searching for alignment at the FAS level.
Bit 3-7/CRC4 Sync Counter Bits (CSC0 and CSC2 to CSC4).
The CRC4 sync counter increments each time the 8ms-CRC4
multiframe search times out. The counter is cleared when the framer has successfully obtained synchronization at the CRC4
level. The counter can also be cleared by disabling the CRC4 mode (E1RCR.3 = 0). This counter is useful for determining the
amount of time the framer has been searching for synchronization at the CRC4 level. ITU G.706 suggests that if
synchronization at the CRC4 level cannot be obtained within 400ms, then the search should be abandoned and proper action
taken. The CRC4 sync counter will rollover. CSC0 is the LSB of the 6-bit counter. (
Note:
The second LSB, CSC1, is not
accessible. CSC1 is omitted to allow resolution to >400ms using 5 bits.)
INFO2
Information Register 2
12h
6
—
0
5
—
0
4
—
0
3
—
0
2
1
0
CRCRC
0
FASRC
0
CASRC
0
X
X
X
X
X
X
X
X
3
2
1
0
FASSA
0
CASSA
0
CRC4SA
0
0
X
X
X
X
X
X
X
X
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PDF描述 |
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