参数资料
型号: DS26524GNA5+
厂商: Maxim Integrated Products
文件页数: 144/273页
文件大小: 0K
描述: IC TXRX T1/E1/J1 QUAD 256-CSBGA
产品培训模块: Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装: 90
类型: 线路接口装置(LIU)
驱动器/接收器数: 4/4
规程: T1/E1/J1
电源电压: 3.135 V ~ 3.465 V
安装类型: 表面贴装
封装/外壳: 256-LBGA,CSBGA
供应商设备封装: 256-CSBGA(17x17)
包装: 托盘
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DS26524 Quad T1/E1/J1 Transceiver
228 of 273
Register Name:
BC2
Register Description:
BERT Control Register 2
Register Address:
1106h + (10h x n): where n = 0 to 3, for Ports 1 to 4
Bit #
7
6
5
4
3
2
1
0
Name
EIB2
EIB1
EIB0
SBE
RPL3
RPL2
RPL1
RPL0
Default
0
Bits 7 to 5: Error Insert Bits 2 to 0 (EIB[2:0]). Will automatically insert bit errors at the prescribed rate into the
generated data pattern. Can be used for verifying error detection features. See Table 9-23.
Table 9-23. BERT Error Insertion Rate
EIB2
EIB1
EIB0
ERROR RATE INSERTED
0
No errors automatically inserted
0
1
10E-1
0
1
0
10E-2
0
1
10E-3
1
0
10E-4
1
0
1
10E-5
1
0
10E-6
1
10E-7
Bit 4: Single Bit Error Insert (SBE). A low-to-high transition will create a single bit error. Must be cleared and set
again for a subsequent bit error to be inserted.
Bits 3 to 0: Repetitive Pattern Length Select 3 to 0 (RPL[3:0]). RPL0 is the LSB and RPL3 is the MSB of a
nibble that describes how long the repetitive pattern is. The valid range is 17 (0000) to 32 (1111). These bits are
ignored if the receive BERT is programmed for a pseudorandom pattern. To create repetitive patterns fewer than
17 bits in length, the user must set the length to an integer number of the desired length that is less than or equal
to 32. For example, to create a 6-bit pattern, the user can set the length to 18 (0001) or to 24 (0111) or to 30
(1101). See Table 9-24.
Table 9-24. BERT Repetitive Pattern Length Select
LENGTH
(BITS)
RPL3
RPL2
RPL1
RPL0
17
0
18
0
1
19
0
1
0
20
0
1
21
0
1
0
22
0
1
0
1
23
0
1
0
24
0
1
25
1
0
26
1
0
1
27
1
0
1
0
28
1
0
1
29
1
0
30
1
0
1
31
1
0
32
1
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PDF描述
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参数描述
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