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参数资料
型号： DS26524GNA5+
厂商： Maxim Integrated Products
文件页数： 186/273页
文件大小： 0K
描述： IC TXRX T1/E1/J1 QUAD 256-CSBGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 90
类型： 线路接口装置（LIU）
驱动器/接收器数： 4/4
规程： T1/E1/J1
电源电压： 3.135 V ~ 3.465 V
安装类型： 表面贴装
封装/外壳： 256-LBGA，CSBGA
供应商设备封装： 256-CSBGA（17x17）
包装： 托盘
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DS26524 Quad T1/E1/J1 Transceiver
266 of 273
13.3 JTAG ID Codes
Table 13-2. ID Code Structure
DEVICE
REVISION
ID[31:28]
DEVICE CODE
ID[27:12]
MANUFACTURER’S CODE
ID[11:1]
REQUIRED
ID[0]
DS26528
Consult factory
0000000000110111
00010100001
1
DS26524
Consult factory
0000000000111001
00010100001
1
13.4 Test Registers
IEEE 1149.1 requires a minimum of two test registers: the bypass register and the boundary scan register. An
optional test register has been included with the DS26524 design. This test register is the identification register and
is used in conjunction with the IDCODE instruction and the Test-Logic-Reset state of the TAP controller.
13.4.1 Boundary Scan Register
This register contains both a shift register path and a latched parallel output for all control cells and digital I/O cells,
and is n bits in length. See Table 13-3 for all the cell bit locations and definitions.
13.4.2 Bypass Register
This is a single one-bit shift register used in conjunction with the BYPASS, CLAMP, and HIGHZ instructions, which
provides a short path between JTDI and JTDO.
13.4.3 Identification Register
The identification register contains a 32-bit shift register and a 32-bit latched parallel output. This register is
selected during the IDCODE instruction and when the TAP controller is in the Test-Logic-Reset state.
Table 13-3. Boundary Scan Control Bits
CELL#
NAME
TYPE
CONTROL
CELL
0
—
controlr
1
rser(1)
output3
0
2
—
controlr
3
rm_rfsync(1)
output3
2
4
rm_rfsync(1)
observe_only
5
—
controlr
6
rsync(1)
output3
5
7
rsync(1)
observe_only
8
—
controlr
9
tsig(1)
output3
8
10
tsig(1)
observe_only
11
—
controlr
12
tsync(1)
output3
11
13
tsync(1)
observe_only
14
tser(1)
observe_only
15
tclk(1)
observe_only
16
—
controlr
17
tchblk_clk(1)
output3
16
18
tchblk_clk(1)
observe_only
19
—
controlr
CELL#
NAME
TYPE
CONTROL
CELL
20
rchblk_clk(2)
output3
19
21
rchblk_clk(2)
observe_only
22
—
controlr
23
rsig(2)
output3
22
24
rsig(2)
observe_only
25
—
controlr
26
rlf_ltc(2)
output3
25
27
—
controlr
28
al_rsigf_flos(2)
output3
27
29
—
controlr
30
rser(2)
output3
29
31
—
controlr
32
rm_rfsync(2)
output3
31
33
rm_rfsync(2)
observe_only
34
—
controlr
35
rsync(2)
output3
34
36
rsync(2)
observe_only
37
—
controlr
38
tsig(2)
output3
37
39
tsig(2)
observe_only
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PDF描述
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参数描述
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