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参数资料
| 型号： | DS3164N |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 132/384页 |
| 文件大小： | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 类型： | PHY 收发器 |
| 应用： | 测试设备 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-BBGA |
| 供应商设备封装： | 400-PBGA（27x27） |
| 包装： | 托盘 |
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DS3161/DS3162/DS3163/DS3164
Bits 1 to 0: General-Purpose I/O 1 Select [1:0] (GPIO1S[1:0]). These bits determine the function of the GPIO1
pin.
00 = Input
01 = Port 1 A status output selected by PORT.CR4:GPIOA[3:0] in port control registers
10 = Output logic 0
11 = Output logic 1
Register Name:
GL.ISR
Register Description:
Global Interrupt Status Register
Register Address:
010h
Bit #
15
14
13
12
11
10
9
8
Name
--
Bit #
7
6
5
4
3
2
1
0
Name
PISR4
PISR3
PISR2
PISR1
--
TSSR
GSR
Bits 15 to 8: Not Used (--)
Bits 7 to 4: Port Interrupt Status Register [4:1] (PISR[4:1] ) The corresponding bit is set when any of the bits in
the port interrupt status registers (PORT.ISR) are set. The
INT interrupt pin will be driven low when any bit is set
and the corresponding GL.ISRIE.PISRIE[4:1] interrupt enable bit is enabled.
Bit 1: Transmit System Interface Status Register Interrupt Status (TSSR) This bit is set when any of the
latched status register bits in the transmit system interface are set and enabled for interrupt. The
INT pin will be
driven low when this bit is set and the GL.ISRIE.TSSRIE interrupt enable bit is enabled.
Bit 0: Global Status Register Interrupt Status (GSR) This bit is set when any of the latched status register bits
in the global latched status register (GL.SRL) are set and enabled for interrupt. The
INT interrupt pin will be driven
low when this bit is set and the GL.ISRIE.GSRIE interrupt enable bit is enabled.
Register Name:
GL.ISRIE
Register Description:
Global Interrupt Status Register Interrupt Enable
Register Address:
012h
Bit #
15
14
13
12
11
10
9
8
Name
--
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
PISRIE4
PISRIE3
PISRIE2
PISRIE1
--
TSSRIE
GSRIE
Default
0
Bits 15 to 8: Not Used (--)
Bits 7 to 4: Port Interrupt Status Register Interrupt Enable [4:1] (PISRIE[4:1]) When any interrupt enable bit in
this group is enabled corresponding to a status bit set in the GL.ISR.PISR[4:1] status bit group, the
INT pin will be
driven low.
0 = interrupt disabled
1 = interrupt enabled
Bit 1: Transmit System Interface Status Register Interrupt Status Interrupt Enable (TSSRIE) When this bit is
enabled, and the GL.ISR.TSSR status bit is set, the
INT pin will be driven low.
0 = interrupt disabled
1 = interrupt enabled
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相关代理商/技术参数 |
参数描述 |
|---|---|
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