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参数资料
| 型号： | DS3164N |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 224/384页 |
| 文件大小： | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 类型： | PHY 收发器 |
| 应用： | 测试设备 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-BBGA |
| 供应商设备封装： | 400-PBGA（27x27） |
| 包装： | 托盘 |
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DS3161/DS3162/DS3163/DS3164
6.6 DS3/E3 G.751 PLCP ATM Mode
DS3/E3 G.751 PLCP ATM mode is a normal mode of operation for the DS316x device, which maps/de-maps ATM
cells into/from the DS3/E3 PLCP data stream. Major functional blocks for the DS3/E3 ATM/Packet mode are
shown in Figure 6-6. Mapping configuration is programmable on per port basis and is shown in Table 6-6.
The PMCPE configuration bit is ignored when in PLCP mode and ATM cell processing is forced.
Table 6-6. DS3/E3 G.751 PLCP ATM Mode Configuration Registers
MODE
FM[5:0]
SIM[1:0]
PMCPE
PORT.CR2
UTOPIA L2 ATM
0XX100
00
X
UTOPIA L3 ATM
0XX100
01
X
POS-PHY L2 ATM
0XX100
10
1
POS-PHY L3 ATM
0XX100
11
1
POS-PHY L2 Packet
0XX100
10
0
POS-PHY L3 Packet
0XX100
11
0
Figure 6-6. DS3/E3 G.751 PLCP ATM Mode
TOHE
Nn
TS
OFIn
TP
OHE
N
n
TP
OHS
O
Fn
IEEE 1149.1
JTAG Test
Access Port
RST
Microprocessor
Interface
HDLC
FEAC
Tx Cell
Processor
Tx
FIFO
System
Interface
Rx Cell
Processor
Rx
FIFO
ROHn
ROHCLK
n
ROHS
OFn
TOHn
TOHCLK
n
TOHS
OFn
TCLK
In
SLB
TX
PLCP
RX PLCP
TX
BERT
RX
BERT
CLK
A
CLK
B
CLK
C
RP
OHn
RP
OHCLK
n
/RCLK
O
n
RP
OHS
O
Fn
TP
OHn
TRAIL
TRACE
UA1
GEN
LLB
DL
B
TAIS
TUA1
Clock Rate
Adapter
B3ZS/
HDB3
Encoder
B3ZS/
HDB3
Decoder
DS3 / E3
Transmit
Formatter
DS3 / E3
Receive
Framer
PLB
n = port # (1-4)
AL
B
RLCLKn
TPOSn/
TDATn
TNEGn/
TOHMOn/
TLCLKn
RDATn
RPOSn/
RNEGn/
RLCVn/
ROHMIn
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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