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参数资料
| 型号： | DS3164N |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 324/384页 |
| 文件大小： | 0K |
| 描述： | IC QUAD ATM/PACKET PHY 400-PBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 1 |
| 类型： | PHY 收发器 |
| 应用： | 测试设备 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-BBGA |
| 供应商设备封装： | 400-PBGA（27x27） |
| 包装： | 托盘 |
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DS3161/DS3162/DS3163/DS3164
8.2 Detailed Pin Descriptions
Table 8-2. Detailed Pin Descriptions
n = 1,2,3,4 (port number); Ipu (input with pullup); Oz (output tri-stateable, needs an external pullup or pulldown resistor to keep from floating);
Oa (analog output); Ia (analog input); I/O (bidirectional inout); all unused input pins without pullup should be tied low.
PIN
TYPE
FUNCTION
LINE I/O
TLCLKn
O
Transmit Line Clock Output
TLCLKn: This clock is typically used as the clock reference for the TPOSn / TDATn
and TNEG / TOHMOn signals, but can also be used as the reference for the TOHMIn
/ TSOFIn, TFOHn / TSERn, TFOHENIn and TSOFOn / TDENn / TFOHENOn signals.
This output signal can be inverted.
o
DS3: 44.736 MHz +20 ppm
o
E3: 34.368 MHz +20 ppm
o
CC52: 52 MHz +20 ppm
TPOSn /
TDATn
O
Transmit Positive AMI / Data Output
TPOSn: When the port line interface is configured for B3ZS, HDB3 or AMI mode and
the framer is not configured for one of the “-OHM” modes (see Table 10-30), a high
on this pin indicates that a positive pulse should be transmitted on the line. The signal
is updated on the positive clock edge of the referenced clock pin if the clock pin signal
is not inverted, otherwise it is updated on the falling edge of the clock. The signal is
typically referenced to the TLCLKn line clock output pins, but it can be referenced to
the TCLKOn, TCLKIn, RLCLKn or RCLKOn pins.
This output signal can be inverted.
TDATn: When the port line interface is configured for UNI mode or the framer is
configured for one of the “-OHM” modes (see Table 10-30), the un-encoded transmit
signal is output on this pin. The signal is updated on the positive clock edge of the
referenced clock pin if the clock pin signal is not inverted, otherwise it is updated on
the falling edge of the clock. The signal is typically referenced to the TLCLK line clock
output pins, but it can be referenced to the TCLKOn, TCLKIn, RLCLKn or RCLKOn
pins
This output signal can be inverted.
o
DS3: 44.736 Mbps +20ppm
o
E3: 34.368 Mbps +20ppm
o
CC52: 52 Mbps +20ppm
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