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参数资料
| 型号： | DTMFDECODER-RD |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 117/178页 |
| 文件大小： | 0K |
| 描述： | KIT REF DESIGN DTMF DECODER |
| 应用说明： | DTMF Decoder Ref Design AppNote |
| 标准包装： | 1 |
| 主要目的： | 电信，DTMF 解码器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | C8051F300 |
| 主要属性： | 8kHz 采样速率模数转换器 |
| 次要属性： | 16 个 Goertzel 滤波器 |
| 已供物品： | 板，软件 |
| 产品目录页面： | 627 (CN2011-ZH PDF) |
| 相关产品： | 336-1535-5-ND - IC 8051 MCU 8K FLASH 14-SOIC C8051F300-GMR-ND - IC 8051 MCU 8K FLASH 11QFN 336-1245-ND - IC 8051 MCU 8K FLASH 11QFN |
| 其它名称： | 336-1283 |
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Rev. 2.9
43
C8051F300/1/2/3/4/5
SFR Definition 5.2. ADC0CF: ADC0 Configuration (C8051F300/2)
Bits7–3: AD0SC4–0: ADC0 SAR Conversion Clock Period Bits.
SAR Conversion clock is derived from system clock by the following equation, where
AD0SC refers to the 5-bit value held in bits AD0SC4-0. SAR Conversion clock requirements
are given in Table 5.1.
Bit2:
UNUSED. Read = 0b; Write = don’t care.
Bits1–0: AMP0GN1–0: ADC0 Internal Amplifier Gain (PGA).
00: Gain = 0.5
01: Gain = 1
10: Gain = 2
11: Gain = 4
R/W
Reset Value
AD0SC4
AD0SC3
AD0SC2
AD0SC1
AD0SC0
—
AMP0GN1 AMP0GN0 11111000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0xBC
AD0SC
SYSCLK
CLK
SAR
----------------------
1
–
=
SFR Definition 5.3. ADC0: ADC0 Data Word (C8051F300/2)
Bits7–0: ADC0 Data Word.
ADC0 holds the output data byte from the last ADC0 conversion. When in Single-ended
mode, ADC0 holds an 8-bit unsigned integer. When in Differential mode, ADC0 holds a 2’s
complement signed 8-bit integer.
R/W
Reset Value
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0xBE
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PDF描述 |
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