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参数资料
| 型号： | DTMFDECODER-RD |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 59/178页 |
| 文件大小： | 0K |
| 描述： | KIT REF DESIGN DTMF DECODER |
| 应用说明： | DTMF Decoder Ref Design AppNote |
| 标准包装： | 1 |
| 主要目的： | 电信，DTMF 解码器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | C8051F300 |
| 主要属性： | 8kHz 采样速率模数转换器 |
| 次要属性： | 16 个 Goertzel 滤波器 |
| 已供物品： | 板，软件 |
| 产品目录页面： | 627 (CN2011-ZH PDF) |
| 相关产品： | 336-1535-5-ND - IC 8051 MCU 8K FLASH 14-SOIC C8051F300-GMR-ND - IC 8051 MCU 8K FLASH 11QFN 336-1245-ND - IC 8051 MCU 8K FLASH 11QFN |
| 其它名称： | 336-1283 |
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Rev. 2.9
151
C8051F300/1/2/3/4/5
15.2. Timer 2
Timer 2 is a 16-bit timer formed by two 8-bit SFRs: TMR2L (low byte) and TMR2H (high byte). Timer 2 may
operate in 16-bit auto-reload mode or (split) 8-bit auto-reload mode. The T2SPLIT bit (TMR2CN.3) defines
the Timer 2 operation mode.
Timer 2 may be clocked by the system clock, the system clock divided by 12, or the external oscillator
source divided by 8. The external clock mode is ideal for real-time clock (RTC) functionality, where the
internal oscillator drives the system clock while Timer 2 (and/or the PCA) is clocked by an external preci-
sion oscillator. Note that the external oscillator source divided by 8 is synchronized with the system clock.
15.2.1. 16-bit Timer with Auto-Reload
When T2SPLIT (TMR2CN.3) is zero, Timer 2 operates as a 16-bit timer with auto-reload. Timer 2 can be
clocked by SYSCLK, SYSCLK divided by 12, or the external oscillator clock source divided by 8. As the
16-bit timer register increments and overflows from 0xFFFF to 0x0000, the 16-bit value in the Timer 2
reload registers (TMR2RLH and TMR2RLL) is loaded into the Timer 2 register as shown in Figure 15.4,
and the Timer 2 High Byte Overflow Flag (TMR2CN.7) is set. If Timer 2 interrupts are enabled (if IE.5 is
set), an interrupt will be generated on each Timer 2 overflow. Additionally, if Timer 2 interrupts are enabled
and the TF2LEN bit is set (TMR2CN.5), an interrupt will be generated each time the lower 8 bits (TMR2L)
overflow from 0xFF to 0x00.
External Clock / 8
SYSCLK / 12
SYSCLK
TMR2L
TMR2H
TMR2RLL TMR2RLH
Reload
TCLK
0
1
TR2
TMR2
CN
T2SPLIT
TF2L
TF2H
T2XCLK
TR2
0
1
T2XCLK
CKCON
T
2
M
H
S
C
A
0
S
C
A
1
T
2
M
L
T
1
M
T
0
M
Interrupt
TF2LEN
To ADC,
SMBus
To SMBus
TMR2L
Overflow
Figure 15.4. Timer 2 16-Bit Mode Block Diagram
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PDF描述 |
|---|---|
| UPZ2E121MND9 | CAP ALUM 120UF 250V 20% RADIAL |
| A3KKB-1036M | IDC CABLE - APK10B/AE10M/APK10B |
| UVR2G101MRD6 | CAP ALUM 100UF 400V 20% RADIAL |
| LLS2A102MELZ | CAP ALUM 1000UF 100V 20% SNAP |
| SI5310-EVB | BOARD EVALUATION FOR SI5310 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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