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参数资料
| 型号： | EC000UM |
| 英文描述： | EC000 Core User＇s Manual (SCM68000) |
| 中文描述： | EC000核心用户手册（SCM68000） |
| 文件页数： | 37/145页 |
| 文件大小： | 829K |
| 代理商： | EC000UM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页当前第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页
Electrical Characteristics
7-2
EC000 CORE PROCESSOR USER’S MANUAL
MOTOROLA
7.5 AC ELECTRICAL SPECIFICATIONS—CLOCK TIMING (see Figure 7-1)
7.6 AC ELECTRICAL SPECIFICATIONS—READ AND WRITE CYCLES
(Frequency = 0 to 20 MHz; GND = 0 V; TA = TL to TH; see Figure 7-2 and Figure 7-3)
Num
Characteristic
3.3 V
5.0 V
Unit
Min
Max
Min
Max
Frequency of Operation
—
20.0
—
20.0
MHz
1
Cycle Time
50
—
50
—
ns
2,3
Clock Pulse Width
25
—
25
—
ns
4,5
Clock Rise and Fall Times
—4—4
ns
Figure 7-1. Clock Input Timing Diagram
Num
Characteristic
3.3 V
5.0 V
Unit
Min
Max
Min
Max
6
Clock High to Address Valid
—
20
—
18
ns
6A
Clock High to FC Valid
0
20
0
18
ns
7
Clock High to Address, Data Bus High Impedance (Maximum)
(Write)
—25—20
ns
8
Clock High to Address, FC Invalid (Minimum)
0—0—
ns
9
Clock High to ASB, DSB Asserted
1
20
1
18
ns
111
Address Valid to ASB, DSB Asserted (Read)/ASB Asserted
(Write)
40—40—
ns
11A1
FC Valid to ASB, DSB Asserted (Read)/ASB Asserted (Write)
40
—
40
—
ns
12
Clock Low to ASB, DSB Negated
1
20
1
18
ns
131
ASB, DSB Negated to Address, FC Invalid
10
—
10
—
ns
141,5
ASB and DSB Width Asserted (Read)/ASB Width Asserted
(Write)
100
—
100
—
ns
14A6
DSB Width Asserted (Write)
50
—
50
—
ns
151
ASB, DSB Width Negated (Read)/ASB Width Negated (Write)
50
—
50
—
ns
171,7
ASB, DSB Negated to RWB Invalid
5—5—
ns
18
Clock High to RWB High (Read)
0
20
0
18
ns
20
Clock High to RWB Low (Write)
0
20
0
18
ns
20A
ASB Asserted to RWB Low (Write)
—
10
—
10
ns
211
Address Valid to RWB Low (Write)
0—0—
ns
21A1
FC Valid to RWB Low (Write)
25
—
25
—
ns
221
RWB Low to DSB Asserted (Write)
10
—
10
—
ns
23
Clock Low to Data-Out Valid (Write)
—
20
—
18
ns
0.2 VDD
0.8 VDD
Timing measurements are referenced to and from a low voltage of 0.2 VDD and a high
voltage of 0.8 VDD, unless otherwise noted. The voltage swing through this range
should start outside and pass through the range such that the rise or fall will be linear
between 0.2 VDD and 0.8 VDD.
4
5
2
1
3
NOTE:
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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