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参数资料
| 型号： | EC000UM |
| 英文描述： | EC000 Core User＇s Manual (SCM68000) |
| 中文描述： | EC000核心用户手册（SCM68000） |
| 文件页数： | 88/145页 |
| 文件大小： | 829K |
| 代理商： | EC000UM |
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Bus Operation
3-6
EC000 CORE PROCESSOR USER’S MANUAL
MOTOROLA
A bus cycle has a minimum of eight states. The various signals are asserted during specific
states of a read cycle, as follows:
STATE 0
The read cycle starts in state 0 (S0). The SCM68000 places valid function codes on FC2–
FC0, and a valid address on the address bus. RWB and ERWB are driven to logic highs
to identify a read cycle, and TSCAE is driven to a logic high to indicate that the SCM68000
is between bus cycles.
Figure 3-6. Word and Byte Read Cycle Timing Diagram for 16-Bit Mode
S0 S1 S2 S3 S4 S5 S6 S7 S0
S1 S2 S3 S4 S5 S6 S7 S0 S1 S2 S3 S4 S5 S6 S7
CLKI
FC2–FC0
A31–A0
ASB
UDSB
LDSB
RWB
DTACKB
D15–D8
D7–D0
WORD READ
ODD BYTE READ
EVEN BYTE READ
DSB
ERWB
AOEB
COEB
DOEB
RMCB
SIZ1–SIZ0
TSCAE
A0=0
A0=1
A0=0
F
re
e
sc
a
le
S
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m
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o
n
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u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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