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参数资料
| 型号： | EPF10K100EQI208-1DX |
| 英文描述： | ASIC |
| 中文描述： | 专用集成电路 |
| 文件页数： | 72/120页 |
| 文件大小： | 1901K |
| 代理商： | EPF10K100EQI208-1DX |
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Altera Corporation
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FLEX 10KE Embedded Programmable Logic Family Data Sheet
Figure 28. Synchronous Bidirectional Pin External Timing Model
parameters and their symbols. Detailed timing information for these
devices will be released as it is available.
PRN
CLRN
DQ
PRN
CLRN
DQ
PRN
CLRN
DQ
Dedicated
Clock
Bidirectional
Pin
Output Register
tINSUBIDIR
tOUTCOBIDIR
tXZBIDIR
tZXBIDIR
tINHBIDIR
OE Register
Input Register
Table 24. LE Timing Microparameters (Part 1 of 2)
Symbol
Parameter
Condition
tLUT
LUT delay for data-in
tCLUT
LUT delay for carry-in
tRLUT
LUT delay for LE register feedback
tPACKED
Data-in to packed register delay
tEN
LE register enable delay
tCICO
Carry-in to carry-out delay
tCGEN
Data-in to carry-out delay
tCGENR
LE register feedback to carry-out delay
tCASC
Cascade-in to cascade-out delay
tC
LE register control signal delay
tCO
LE register clock-to-output delay
tCOMB
Combinatorial delay
tSU
LE register setup time for data and enable signals before clock; LE register
recovery time after asynchronous clear, preset, or load
tH
LE register hold time for data and enable signals after clock
tPRE
LE register preset delay
相关PDF资料 |
PDF描述 |
|---|---|
| EPF10K100EQI208-2 | Field Programmable Gate Array (FPGA) |
| EPF10K100EQI208-2DX | ASIC |
| EPF10K100EQI208-3DX | ASIC |
| EPF10K130EBC600-1X | Field Programmable Gate Array (FPGA) |
| EPF10K130EBC600-2 | Field Programmable Gate Array (FPGA) |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EPF10K100EQI208-2 | 功能描述:FPGA - 现场可编程门阵列 FPGA - Flex 10K 624 LABs 147 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 栅极数量: 逻辑块数量:943 内嵌式块RAM - EBR:1956 kbit 输入/输出端数量:128 最大工作频率:800 MHz 工作电源电压:1.1 V 最大工作温度:+ 70 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-256 |
| EPF10K100EQI208-2DX | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
| EPF10K100EQI208-3DX | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
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| EPF10K100EQI240-2DX | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
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