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参数资料
| 型号： | EPF10K30RC208-3N |
| 厂商： | Altera |
| 文件页数： | 80/128页 |
| 文件大小： | 0K |
| 描述： | IC FLEX 10K FPGA 30K 208-RQFP |
| 产品培训模块： | Three Reasons to Use FPGA's in Industrial Designs |
| 产品变化通告： | Package Change 30/Jun/2010 |
| 标准包装： | 48 |
| 系列： | FLEX-10K® |
| LAB/CLB数： | 216 |
| 逻辑元件/单元数： | 1728 |
| RAM 位总计： | 12288 |
| 输入/输出数： | 147 |
| 门数： | 69000 |
| 电源电压： | 4.75 V ~ 5.25 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 208-BFQFP 裸露焊盘 |
| 供应商设备封装： | 240-RQFP（32x32） |
| 其它名称： | 544-2228 |
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Altera Corporation
55
FLEX 10K Embedded Programmable Logic Device Family Data Sheet
Figure 23. Output Drive Characteristics for EPF10K250A Device
Timing Model
The continuous, high-performance FastTrack Interconnect routing
resources ensure predictable performance and accurate simulation and
timing analysis. This predictable performance contrasts with that of
FPGAs, which use a segmented connection scheme and therefore have
unpredictable performance.
Device performance can be estimated by following the signal path from a
source, through the interconnect, to the destination. For example, the
registered performance between two LEs on the same row can be
calculated by adding the following parameters:
■
LE register clock-to-output delay (tCO)
■
Interconnect delay (tSAMEROW)
■
LE look-up table delay (tLUT)
■
LE register setup time (tSU)
The routing delay depends on the placement of the source and destination
LEs. A more complex registered path may involve multiple combinatorial
LEs between the source and destination LEs.
VCCINT = 3.3 V
VCCIO = 3.3 V
Room Temperature
VCCINT = 3.3 V
VCCIO = 2.5 V
Room Temperature
VO Output Voltage (V)
1234
VO Output Voltage (V)
1234
10
20
30
50
40
10
20
30
50
40
IOL
IOH
IOL
IOH
Typical IO
Output
Current (mA)
Typical IO
Output
Current (mA)
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PDF描述 |
|---|---|
| HBC50DRAS | CONN EDGECARD 100PS R/A .100 SLD |
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参数描述 |
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