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参数资料
| 型号： | EPF6010A |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family(FLEX6000可编程逻辑系列器件) |
| 中文描述： | 可编程逻辑器件系列（FLEX6000可编程逻辑系列器件） |
| 文件页数： | 15/21页 |
| 文件大小： | 241K |
| 代理商： | EPF6010A |
Altera Corporation
933
AN 92: Understanding FLEX 6000 Timing
Examples
The following examples show how to use internal timing
microparameters to estimate the delays for real applications.
Example 1: 4-Bit Equality Comparator with a Cascade Chain
You can analyze the timing delays for circuits that have been subjected to
minimization and logic synthesis. The synthesized equations are available
in your project’s MAX+PLUS II Report File (
.rpt
). These equations are
structured so that you can quickly determine the logic implementation of
any signal. For example,
Figure 4
shows a 4-bit equality comparator.
Figure 4. 4-Bit Equality Comparator Circuit
CASCADE
a0
b0
a1
b1
a2
b2
a3
b3
eq
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PDF描述 |
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