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参数资料
| 型号： | EPM2210GF324A5N |
| 厂商： | ALTERA CORP |
| 元件分类： | PLD |
| 英文描述： | FLASH PLD, PBGA324 |
| 封装： | 19 X 19 MM, 1 MM PITCH, LEAD FREE, FBGA-324 |
| 文件页数： | 30/108页 |
| 文件大小： | 1342K |
| 代理商： | EPM2210GF324A5N |
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2–20Core Version a.b.c variable
Altera Corporation
MAX II Device Handbook, Volume 1
March 2008
Global Signals
The UFM block communicates with the logic array similar to LAB-to-LAB
interfaces. The UFM block connects to row and column interconnects and
has local interconnect regions driven by row and column interconnects.
This block also has DirectLink interconnects for fast connections to and
from a neighboring LAB. For more information about the UFM interface
to the logic array, see “User Flash Memory Block” on page 2–23.
Table 2–2 shows the MAX II device routing scheme.
Global Signals
Each MAX II device has four dual-purpose dedicated clock pins
(GCLK[3..0], two pins on the left side and two pins on the right side)
that drive the global clock network for clocking, as shown in Figure 2–13.
These four pins can also be used as general-purpose I/O if they are not
used to drive the global clock network.
The four global clock lines in the global clock network drive throughout
the entire device. The global clock network can provide clocks for all
resources within the device including LEs, LAB local interconnect, IOEs,
and the UFM block. The global clock lines can also be used for global
Table 2–2. MAX II Device Routing Scheme
Source
Destination
LUT
Chain
Register
Chain
Local
DirectLink
R4 (1)
C4 (1)
LE
UFM
Block
Column
IOE
Row
IOE
Fast I/O
LUT Chain
—
v
——
—
Register
Chain
——
—
v
——
—
Local
Interconnect
——
—
vv
v
—
DirectLink
Interconnect
——
v
——
—
R4
Interconnect
——
v
—
vv
——
—
C4
Interconnect
——
v
—
vv
——
—
LE
vv
v
——
vv
v
UFM Block
—
vv
v
——
—
Column IOE
—
v
——
—
Row IOE
—
vv
v
——
—
Note to Table 2–2
(1)
These categories are interconnects.
相关PDF资料 |
PDF描述 |
|---|---|
| EPM7064BFC100-3 | EE PLD, 3.5 ns, PBGA100 |
| EPM7064BFC100-5 | EE PLD, 3.5 ns, PBGA100 |
| EPM7064BFC100-7 | EE PLD, 3.5 ns, PBGA100 |
| EPM7064BTC100-3 | EE PLD, 3.5 ns, PQFP100 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| EPM2210GF324C3N | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX II 1700 Macro 272 IO RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM2210GF324C4 | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX II 1700 Macro 272 IO RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM2210GF324C4N | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX II 1700 Macro 272 IO RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| EPM2210GF324C5 | 功能描述:CPLD - 复杂可编程逻辑器件 CPLD - MAX II 1700 Macro 272 IO RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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