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参数资料
| 型号： | EPM7256SRI208-10N |
| 厂商： | Altera |
| 文件页数： | 64/66页 |
| 文件大小： | 0K |
| 描述： | IC MAX 7000 CPLD 256 208-RQFP |
| 产品变化通告： | Package Change 30/Jun/2010 |
| 标准包装： | 24 |
| 系列： | MAX® 7000 |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 10.0ns |
| 电压电源 - 内部： | 4.5 V ~ 5.5 V |
| 逻辑元件/逻辑块数目： | 16 |
| 宏单元数： | 256 |
| 门数： | 5000 |
| 输入/输出数： | 164 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-BFQFP 裸露焊盘 |
| 供应商设备封装： | 208-RQFP（28x28） |
| 包装： | 托盘 |
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Altera Corporation
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MAX 7000 Programmable Logic Device Family Data Sheet
The MAX 7000 architecture includes four dedicated inputs that can
be used as general-purpose inputs or as high-speed, global control
signals (clock, clear, and two output enable signals) for each
macrocell and I/O pin. Figure 1 shows the architecture of EPM7032,
EPM7064, and EPM7096 devices.
Figure 1. EPM7032, EPM7064 & EPM7096 Device Block Diagram
I/O
Control
Block
8 to 16
I/O pins
8 to 16
16
36
I/O
Control
Block
8 to 16
I/O pins
36
8 to 16
16
8 to 16
I/O pins
36
8 to 16
16
I/O
Control
Block
I/O
Control
Block
8 to 16
I/O pins
8 to 16
16
36
LAB A
LAB B
LAB C
Macrocells
33 to 48
LAB D
INPUT/GCLRn
INPUT/OE1
INPUT/OE2
Macrocells
17 to 32
Macrocells
49 to 64
PIA
INPUT/GLCK1
Macrocells
1 to 16
相关PDF资料 |
PDF描述 |
|---|---|
| EPM7256SRI208-10 | IC MAX 7000 CPLD 256 208-RQFP |
| VI-2WX-CY-F2 | CONVERTER MOD DC/DC 5.2V 50W |
| TAP105M035HSB | CAP TANT 1UF 35V 20% RADIAL |
| ABM30DTAS | CONN EDGECARD 60POS R/A .156 SLD |
| EPM7512AETC144-12N | IC MAX 7000 CPLD 512 144-TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EPM7256WC208-20 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:UV-Erasable/OTP Complex PLD |
| EPM7256WC208-25 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:UV-Erasable/OTP Complex PLD |
| EPM7384AEFC256-10 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Electrically-Erasable Complex PLD |
| EPM7384AEFC256-12 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Electrically-Erasable Complex PLD |
| EPM7384AEFC256-7 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Electrically-Erasable Complex PLD |
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