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参数资料
| 型号： | HB28H016RM2 |
| 英文描述： | IC Memory CompactFlash /PC-ATA Standard Users Manual/Device |
| 中文描述： | 集成电路记忆的CompactFlash / PC的ATA标准用户手册/设备 |
| 文件页数： | 30/103页 |
| 文件大小： | 466K |
| 代理商： | HB28H016RM2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页当前第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页
24
Table 3.5
Common Memory Read Timing
No.
Item
Symbol
Min [ns]
Max [ns]
1
Output enable access time
t
A
(OE)
t
DIS
(OE)
t
SU
(Add)
t
H
(Add)
t
SU
(CE)
t
H
(CE)
t
V
(WIT-OE)
t
V
(WIT)
t
W
(WIT)
125
2
Output disable time from OE
100
3
Address setup time
30
4
Address hole time
20
5
CE setup before OE
0
6
CE hold following OE
20
7
Wait delay falling from OE
35
8
Data setup for wait release
0
9
Wait width time (default speed)
350
t
SU
(CE)
t
H
(CE)
An
t
V
(WIT)
t
A
(OE)
t
DIS
(OE)
Dout
t
SU
(A)
t
H
(A)
REG
CE
OE
t
W
(WIT)
t
V
(WIT-OE)
WAIT
Data transferred
from card to host
Figure 3.5 Common Memory Read Timing Chart
Note:
The
WAIT
maximum load is one 50 pF LS-TTL in total.
The
WAIT
maximum width (slowest mode operation) is stipulated by the CIS section.
If the
OE
cycle-to-cycle time is longer than
WAIT
signal width, the
WAIT
signal may be
ignored.
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